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转换合并法在无线人体局域网的应用
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作者 蔡捷 梁田 杨鸿韬 《创新科技》 2014年第4期72-73,共2页
提高数据质量,增强稳定性以及降低功率损耗是无线BAN 技术不断革新的目标与方向.本文将阐述一种常见的无线通讯技术,转换合并法(Switched Combining),在无线BAN上的应用以及对上述性能的影响与权衡(trade-off).
关键词 转换合并 无线人体局域网 功率控制
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基于CPLD芯片EPM7128设计的数据合并转换器 被引量:2
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作者 魏占永 《电子技术应用》 北大核心 2002年第11期56-58,共3页
介绍了基于CPLD芯片EPM7128设计的数据合并转换器。其中,控制串行口数据合并时间的计数器电路和并行数据转换成串行数据的移位电路都是在CPLD中完成的,数据块合并由相应的软件实现,最终形成PCM流输出。
关键词 EPM7128 CPLD 数据合并转换 串行口 PCM流
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合并报表转换问题探析——针对国有企业集团所属事业单位 被引量:1
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作者 陈宝铭 《中国注册会计师》 北大核心 2013年第10期111-114,共4页
国务院国资委要求在不改变事业单位现行会计制度和报表体系的前提下,将事业单位会计报表转换为企业会计报表,以纳入集团财务报表合并的范围。这种转换存在一定的必要性,但是在实际操作过程中却存在一些问题,比如"财政应返还额度&qu... 国务院国资委要求在不改变事业单位现行会计制度和报表体系的前提下,将事业单位会计报表转换为企业会计报表,以纳入集团财务报表合并的范围。这种转换存在一定的必要性,但是在实际操作过程中却存在一些问题,比如"财政应返还额度"科目属于货币资金还是债权,"零余额账户用款额度"是否属于货币资金",固定基金"是否等同于"实收资本"等。针对这些问题,本文提出了一些改进意见。 展开更多
关键词 事业单位 合并转换 科目转换
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基于CPLD开发的高速数据合并转换器
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作者 魏占永 潘凤娥 《半导体技术》 CAS CSCD 北大核心 2002年第12期54-56,共3页
送到终端显示器显示。其中控制数据合并时间的计数器电路和并行数据转换成串行数据的移位电路都是在CPLD中形成的,并且由相应的软件控制成为帧频可编程的数据合并转换器,软件设计由C语言和C++语言来完成的。
关键词 CPLD 数据合并转换 串行口 PCM流 软件设计 交换机
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一种PLC指令表向梯形图的转换方法
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作者 施昊言 王庭有 《化工自动化及仪表》 CAS 2022年第5期626-629,651,共5页
指令表向梯形图的转换功能在PLC编程软件中具有重要作用,设立两个坐标点用于确定转换后梯形图在界面中的坐标,为指令表语言添加标志位并将每条指令压栈,通过指令对栈深的影响改变梯形图的显示坐标,最终实现指令表到梯形图的转换。
关键词 合并转换算法 梯形图 指令表 转换算法 PLC
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An 85mW 14-bit 150MS/s Pipelined ADC with a Merged First and Second MDAC 被引量:6
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作者 LI Weitao LI Fule +2 位作者 YANG Changyi LI Shengjing WANG Zhihua 《China Communications》 SCIE CSCD 2015年第5期14-21,共8页
A low-power 14-bit 150MS/s an- alog-to-digital converter (ADC) is present- ed for communication applications. Range scaling enables a maximal 2-Vp-p input with a single-stage opamp adopted. Opamp and capacitor shari... A low-power 14-bit 150MS/s an- alog-to-digital converter (ADC) is present- ed for communication applications. Range scaling enables a maximal 2-Vp-p input with a single-stage opamp adopted. Opamp and capacitor sharing between the first multi- plying digital-to-analog converter (MDAC) and the second one reduces the total opamp power further. The dedicated sample-and- hold amplifier (SHA) is removed to lower the power and the noise. The blind calibration of linearity errors is proposed to improve the per- formance. The prototype ADC is fabricated in a 130rim CMOS process with a 1.3-V supply voltage. The SNDR of the ADC is 71.3 dB with a 2.4 MHz input and remains 68.5 dB for a 120 MHz input. It consumes 85 roW, which includes 57 mW for the ADC core, 11 mW for the low jitter clock receiver and 17 mW for the high-speed reference buffer. 展开更多
关键词 analog-to-digital conversion LOWPOWER CALIBRATION high speed and high reso-lution pipelined analog-to-digital converter CMOS analog integrated circuits
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Time Evolution and Squeezing of Degenerate and Non-degenerate Coupled Parametric Down-Conversion with Driving Term
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作者 LI Jiang-Fan FANG Jia-Yuan XIAO Fu-Liang LIU Xin-Hai WANG Cheng-Zhi 《Communications in Theoretical Physics》 SCIE CAS CSCD 2009年第3期514-518,共5页
By properly selecting the time-dependent unitary transformation for the linear combination of the number operators, we construct a time-dependent invariant and derive the corresponding auxiliary equations for the dege... By properly selecting the time-dependent unitary transformation for the linear combination of the number operators, we construct a time-dependent invariant and derive the corresponding auxiliary equations for the degenerate and non-degenerate coupled parametric down-conversion system with driving term. By means of this invariant and the Lewis-Riesenfeld quantum invariant theory, we obtain closed formulae of the quantum state and the evolution operator of the system. We show that the time evolution of the quantum system directly leads to production of various generalized one- and two-mode combination squeezed states, and the squeezed effect is independent of the driving term of the Hamiltonian. In some special cases, the current solution can reduce to the results of the previous works. 展开更多
关键词 coupled parametric down-conversion time evolution Lewis-Riesenfeld invariant theory Schrodinger equation squeezed states
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