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一种采用新型逻辑算法的SAR ADC 被引量:1
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作者 黄添益 王本艳 +2 位作者 景蔚亮 宋志棠 陈邦明 《微电子学与计算机》 CSCD 北大核心 2018年第7期35-40,共6页
基于SMIC 40nm CMOS工艺,设计了一种12位逐次逼近寄存器式模数转换器(SAR ADC).在正常工作模式的基础上,增加了当模拟输入信号变化缓慢时,锁定前4位,仅转换后8位的工作模式,降低了ADC的功耗,提高了ADC的采样率,同时分辨率保持不变.当模... 基于SMIC 40nm CMOS工艺,设计了一种12位逐次逼近寄存器式模数转换器(SAR ADC).在正常工作模式的基础上,增加了当模拟输入信号变化缓慢时,锁定前4位,仅转换后8位的工作模式,降低了ADC的功耗,提高了ADC的采样率,同时分辨率保持不变.当模拟输入信号变化较大时,ADC又可重新回到正常工作模式.在1.1V的电源电压,3.6 MS/s的采样率下,ADC总功耗为43μW,品质因数FOM为10.1fJ/(conv.·step). 展开更多
关键词 逐次逼近寄存器式模数转换器 新型SAR逻辑 锁定adc前几位 低功耗adc
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