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基于WDC结构的低静态功耗Cache设计
1
作者
鲁欣
付宇卓
《上海交通大学学报》
EI
CAS
CSCD
北大核心
2005年第4期606-609,613,共5页
基于片上cache占处理器芯片功耗的比重越来越大,提出了一种新的路衰减cache(Way-DecayCache,WDC)结构.该结构通过门控Gnd技术来动态地关闭或开启部分cache路,使得cache结构可以在低功耗配置和正常配置之间切换,从而达到降低静态功耗的目...
基于片上cache占处理器芯片功耗的比重越来越大,提出了一种新的路衰减cache(Way-DecayCache,WDC)结构.该结构通过门控Gnd技术来动态地关闭或开启部分cache路,使得cache结构可以在低功耗配置和正常配置之间切换,从而达到降低静态功耗的目的.与现有的低功耗cache结构相比,附加的逻辑少,实现简单,具有硬件的可实现性.试验结果表明,该结构可以降低cache的功耗,同时对cache整体的性能影响很小.
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关键词
路衰减cache
门控gnd
低静态功耗
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职称材料
题名
基于WDC结构的低静态功耗Cache设计
1
作者
鲁欣
付宇卓
机构
上海交通大学微电子学院
出处
《上海交通大学学报》
EI
CAS
CSCD
北大核心
2005年第4期606-609,613,共5页
基金
国家高技术研究发展计划(863)项目(2003AA1Z1350)
文摘
基于片上cache占处理器芯片功耗的比重越来越大,提出了一种新的路衰减cache(Way-DecayCache,WDC)结构.该结构通过门控Gnd技术来动态地关闭或开启部分cache路,使得cache结构可以在低功耗配置和正常配置之间切换,从而达到降低静态功耗的目的.与现有的低功耗cache结构相比,附加的逻辑少,实现简单,具有硬件的可实现性.试验结果表明,该结构可以降低cache的功耗,同时对cache整体的性能影响很小.
关键词
路衰减cache
门控gnd
低静态功耗
Keywords
Logic circuits
Logic gates
MOS devices
Power integrated circuits
Static random access storage
VLSI circuits
分类号
TN492 [电子电信—微电子学与固体电子学]
TP302.1 [自动化与计算机技术—计算机系统结构]
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题名
作者
出处
发文年
被引量
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1
基于WDC结构的低静态功耗Cache设计
鲁欣
付宇卓
《上海交通大学学报》
EI
CAS
CSCD
北大核心
2005
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