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塑闪探测器读出系统的高速串行数据传输模块设计
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作者 张岁锴 孔洁 +1 位作者 严春满 魏子洋 《核电子学与探测技术》 CAS 北大核心 2024年第5期847-855,共9页
针对塑闪探测器读出系统对高速串行数据传输的需求,本文设计了一种基于FPGA的高速串行数据传输模块,旨在实现塑闪探测器读出系统的高效数据传输。该模块采用串行/解串(Serializer/Deserializer,SerDes)器件TLK2711,构建全双工点对点的... 针对塑闪探测器读出系统对高速串行数据传输的需求,本文设计了一种基于FPGA的高速串行数据传输模块,旨在实现塑闪探测器读出系统的高效数据传输。该模块采用串行/解串(Serializer/Deserializer,SerDes)器件TLK2711,构建全双工点对点的串行通信协议,逻辑设计涵盖了控制模块、发送模块、接收模块以及发送/接收FIFO等。在FPGA平台上实现后,通过ModelSim进行仿真验证该模块在链路同步、数据帧传输和链路管理的表现。完成仿真后进行上板验证,实现了2.5 Gb/s的高速串行传输速率和小于10-12的误码率。这一设计显著提升了数据传输性能,为塑闪探测器读出系统的精确性和稳定性提供支持。 展开更多
关键词 FPGA TLK2711 SERDES 高速串行数据传输 塑料闪烁体探测器
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高速串行数据链路中基于相位噪声时钟抖动测量 被引量:2
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作者 沈小青 楼杨 +1 位作者 叶玲玲 杨洋 《计算机测量与控制》 2015年第5期1470-1471,1475,共3页
传统并行数据通信随着速度的增加,传输时延已难以准确控制,使得高速串行数据传输成为通信的主要方式,当数据速率超过GB/s水平,时钟信号引入的抖动已成为系统抖动的主要成分,低数据速率抖动分析技术已难以满足要求,相位噪声测量技术在高... 传统并行数据通信随着速度的增加,传输时延已难以准确控制,使得高速串行数据传输成为通信的主要方式,当数据速率超过GB/s水平,时钟信号引入的抖动已成为系统抖动的主要成分,低数据速率抖动分析技术已难以满足要求,相位噪声测量技术在高速串行数据链路抖动分析中提供了解决方案,文章从原理上论述了相位噪声与抖动的关系,以实例给出了通过相位噪声测量间接测量抖动的工程计算方法。 展开更多
关键词 高速串行数据传输 相位噪声 抖动
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一种适用于高速串行数据通信的发送器设计 被引量:1
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作者 刘智 魏海龙 刘佑宝 《微电子学与计算机》 CSCD 北大核心 2009年第5期227-230,共4页
为满足点对点高速串行数据通信的需求,设计了一款适用于点对点高速串行数据通信的发送器芯片.该发送器包括产生高速时钟的内嵌锁相环倍频电路、集成8B/10B编码电路以及并串转换电路等模块.根据数模混合信号设计的特点,在电路设计上采用... 为满足点对点高速串行数据通信的需求,设计了一款适用于点对点高速串行数据通信的发送器芯片.该发送器包括产生高速时钟的内嵌锁相环倍频电路、集成8B/10B编码电路以及并串转换电路等模块.根据数模混合信号设计的特点,在电路设计上采用了CMOS、CML及BiCMOS等多种电路拓扑结构以提高芯片性能;在版图设计上采取了减小噪声耦合的措施.该发送器采用2P2M0.6μmBiCMOS工艺实现,芯片面积2.4mm×2.5mm,陶瓷封装.测试结果表明:该发送器的逻辑功能正确,串行传输速率达400Mbps,功耗350mW. 展开更多
关键词 高速串行数据发送器 锁相环 8B/10B编码 BICMOS工艺
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高速串行数据通讯电路设计及应用 被引量:1
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作者 徐志跃 张田甜 《计算机测量与控制》 CSCD 北大核心 2009年第6期1192-1194,共3页
介绍了Hotlink协议芯片CY7B923/933的性能特点、内部结构、工作原理和工作方式;设计了由CY7B923/933组成的高速串行数据通讯电路,详细讨论了耦合电路、偏置电路、匹配电阻、波形观测等关键性问题;并分别用同轴电缆和双绞线对电路进行了... 介绍了Hotlink协议芯片CY7B923/933的性能特点、内部结构、工作原理和工作方式;设计了由CY7B923/933组成的高速串行数据通讯电路,详细讨论了耦合电路、偏置电路、匹配电阻、波形观测等关键性问题;并分别用同轴电缆和双绞线对电路进行了传输速率为330Mpbs的图像数据的传输测试;实验结果表明,传输过程稳定可靠,没有发生解码错误;CY7B923/933芯片可以方便地实现Hotlink协议,非常适用于工作站、服务器、海量存储、图像和视频传输等方面的应用。 展开更多
关键词 点对点高速串行数据通信 Hotlink协议 8B/10B编码方式 差分PECL信号
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一种基于AFDX的高速串行数据转换接口设计与实现 被引量:1
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作者 张立辉 王红春 +1 位作者 刘智武 白杨 《电脑知识与技术(过刊)》 2015年第4X期192-194,共3页
该文从AFDX端系统与测控系统之间高速串行数据传输的需求出发,设计了一种基于AFDX的高速串行数据转换接口,实现AFDX数据到测控系统自定义数据的转换和传输。该设计利用FPGA内部的缓冲区资源,生成高速接口逻辑单元,通过外部LVDS接口进行... 该文从AFDX端系统与测控系统之间高速串行数据传输的需求出发,设计了一种基于AFDX的高速串行数据转换接口,实现AFDX数据到测控系统自定义数据的转换和传输。该设计利用FPGA内部的缓冲区资源,生成高速接口逻辑单元,通过外部LVDS接口进行数据的传输,大大提高了AFDX端系统的可用性。通过仿真和测试,验证了设计的有效性。 展开更多
关键词 FPGA AFDX 高速串行数据传输 LVDS
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基于PCI总线的DSP高速串行数据接收系统 被引量:3
6
作者 王继胜 桑恩方 高鹏 《电子设计应用》 2003年第8期86-88,44,共4页
本文介绍了基于PCI和DSP的高速串行数据接收系统的原理,给出了系统中高速串行数据通信接收芯片CY7B933与TMS320VC33以及PCI接口控制芯片CY7C09449PV的无缝连接方案、设计思路及实现方法。
关键词 DSP 高速串行数据接收系统 PCI总线 数据通信 数字信号处理器
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基于真三维立体显示的高速串行数据传输设计
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作者 赵龙彪 朱尧 +3 位作者 韩东 史高飞 方勇 吕国强 《现代显示》 2013年第3期22-26,共5页
在真三维显示系统中,有海量图像数据需要高速传输。为了满足数据吞吐量的需求,数据采用多路差分总线的形式进行传输,但是由于电路板布线的差异,会导致数据传输的可靠性降低。本文中采用动态相位调整(DPA)技术,保证了数据传输的可靠性和... 在真三维显示系统中,有海量图像数据需要高速传输。为了满足数据吞吐量的需求,数据采用多路差分总线的形式进行传输,但是由于电路板布线的差异,会导致数据传输的可靠性降低。本文中采用动态相位调整(DPA)技术,保证了数据传输的可靠性和稳定性,满足了真三维显示的需求。 展开更多
关键词 真三维立体显示 动态相位调整 高速串行数据传输
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基于TLK2711的遥感卫星高速串行载荷数据接口设计 被引量:16
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作者 张媚 杜辉 +1 位作者 关晖 潘腾 《航天器工程》 北大核心 2015年第6期13-19,共7页
高分辨率遥感卫星星上载荷原始数据率不断提高,如何将高速载荷数据传输至后端数据处理设备已成为遥感卫星载荷接口设计的关键。在研究高速串行/解串(SerDes)收发器件TLK2711工作原理的基础上,提出了高速串行载荷数据传输接口的设计方案... 高分辨率遥感卫星星上载荷原始数据率不断提高,如何将高速载荷数据传输至后端数据处理设备已成为遥感卫星载荷接口设计的关键。在研究高速串行/解串(SerDes)收发器件TLK2711工作原理的基础上,提出了高速串行载荷数据传输接口的设计方案。通过在某卫星星载数据传输系统中的首次应用,实现了星上2Gbit/s的高速串行数据传输,工程试验和在轨验证表明了接口设计的正确性和可靠性,可为其它星载高速数据传输接口设计提供借鉴。 展开更多
关键词 TLK2711 高速串行数据接口 数据传输 遥感卫星
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300Mbit/s串行高速数据的可靠接收结构 被引量:2
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作者 杨军 张尔扬 《通信学报》 EI CSCD 北大核心 2005年第8期78-83,共6页
针对高速串行数据可靠接收问题,设计了一种高速串行接收电路结构。对比以往文献中的电路,它的适应条件更加宽松,同时性能提高了50%。经过软件仿真和硬件实测,它能在高达310Mbit/s的串行数据速率下稳定工作。这在实际高速数据传输系统中... 针对高速串行数据可靠接收问题,设计了一种高速串行接收电路结构。对比以往文献中的电路,它的适应条件更加宽松,同时性能提高了50%。经过软件仿真和硬件实测,它能在高达310Mbit/s的串行数据速率下稳定工作。这在实际高速数据传输系统中具有广泛的应用价值。 展开更多
关键词 数字电路 高速串行数据 可靠接收 FPGA
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多路基于TLK2711高速串行图像数据的传输系统 被引量:6
10
作者 余达 刘金国 +4 位作者 徐东 孔德柱 陈佳豫 梅贵 周磊 《液晶与显示》 CAS CSCD 北大核心 2017年第10期815-821,共7页
为提高多路高速串行图像数据传输在航天应用中的FPGA IO利用率,同时克服接收到的多路并行恢复数据相对相位不确定性问题,采用时钟分路器同时为多路TLK2711和FPGA提供低抖动时钟。对于串行数据发送,采用FPGA内部的数字时钟管理单元(DCM)... 为提高多路高速串行图像数据传输在航天应用中的FPGA IO利用率,同时克服接收到的多路并行恢复数据相对相位不确定性问题,采用时钟分路器同时为多路TLK2711和FPGA提供低抖动时钟。对于串行数据发送,采用FPGA内部的数字时钟管理单元(DCM)对发送数据的相位进行调整,并采用TLK2711的内部环回功能进行发送数据和时钟相位的动态自适应调整。对于串行数据接收,采用高速异步数据缓存将多路相对相位不确定的数据调理为参考相同时钟,最终转换为满足Camera Link接口协议的图像数据。实验结果表明,采用时钟分路器可大大降低时钟抖动,该传输系统工作稳定可靠,最大传输速率可达6.8Gbit/s。此方法可大大提高FPGA内部的资源利用率,实现多路并行恢复数据的相对确定相位,满足多通道基于TLK2711的高速串行数据的高稳定传输要求。 展开更多
关键词 高速串行图像数据 IO利用率 低抖动时钟 动态自适应调整 相位不确定
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低功耗高速时钟数据恢复电路 被引量:1
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作者 孟时光 杨宗仁 《高技术通讯》 CAS CSCD 北大核心 2016年第6期542-549,共8页
为了降低高速串行接口的时钟数据恢复(CDR)电路的功耗,在研究、分析现有时钟数据恢复结构的基础上,提出了一种新的时钟数据鉴相算法及其电路实现方法。新的电路设计仅使用一个高速采样时钟,比传统的鉴相电路减少一半的采样率,从而减少... 为了降低高速串行接口的时钟数据恢复(CDR)电路的功耗,在研究、分析现有时钟数据恢复结构的基础上,提出了一种新的时钟数据鉴相算法及其电路实现方法。新的电路设计仅使用一个高速采样时钟,比传统的鉴相电路减少一半的采样率,从而减少了前端采样模块的功耗。该鉴相算法采用统计方法减小鉴相时钟的噪声,进而达到很低的误码率。该鉴相算法可使用数字综合的方法实现,工作在较低的频率下,这样便于迁移到不同的工艺中。整个电路使用40nm工艺实现,实际芯片测试数据表明,使用该电路的接收端可以稳定工作在13Gb/s的速率下,功耗达到0.83p J/bit,误码率低于10E-12。 展开更多
关键词 低功耗接收端 高速串行接口 时钟数据恢复( CDR)
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TD-LTE中基于GTX的数据交互的设计 被引量:1
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作者 张德民 汪朋锐 李杨 《广东通信技术》 2013年第6期29-32,37,共5页
基于对TD-LTE射频一致性测试仪中FPGA与FPGA之间高速串行数据通信技术的研究,设计了一种基于FPGA的GTX收发器的高速数据传输方案并采用XINLINX公司的VIRTEX-6 GTX实现。主要阐述了用于解决高速数据交互问题的GTX基本原理和实现过程。经... 基于对TD-LTE射频一致性测试仪中FPGA与FPGA之间高速串行数据通信技术的研究,设计了一种基于FPGA的GTX收发器的高速数据传输方案并采用XINLINX公司的VIRTEX-6 GTX实现。主要阐述了用于解决高速数据交互问题的GTX基本原理和实现过程。经过仿真、综合、板级验证、调试等工作,该设计方案实现了数据的正确传输并已应用于TD-LTE射频一致性测试系统的开发中。 展开更多
关键词 TD-LTE 高速串行数据通信 GTX FPGA实现
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小卫星数传基带数据处理通用集成平台设计 被引量:6
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作者 张敬一 欧民 +1 位作者 毛志毅 刘志佳 《航天器工程》 CSCD 北大核心 2017年第1期79-84,共6页
以传统小卫星数传分系统中对有效载荷数据进行处理的基带数据处理设备及系统管理控制单元为基础,采用高速串行数据线、高集成模块化数字电路、高速大容量存储模块集成、机电协同设计等技术,设计了一种数传基带数据处理通用集成平台。与... 以传统小卫星数传分系统中对有效载荷数据进行处理的基带数据处理设备及系统管理控制单元为基础,采用高速串行数据线、高集成模块化数字电路、高速大容量存储模块集成、机电协同设计等技术,设计了一种数传基带数据处理通用集成平台。与传统小卫星数传分系统同功能设备与线缆设计相比,体积减小约82%,质量减少约75%,功耗降低约50%,能满足小卫星体积和质量小、功耗低的需求。此外,数据流优化设计可使固态存储利用率提升14.3%。文章提出的通用集成平台设计可为小卫星数传分系统的集成设计提供参考。 展开更多
关键词 小卫星 数传基带数据处理 通用集成平台 高速串行数据线 高集成模块化数字电路
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基于FPGA的高速光电接口模块设计
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作者 张剑锋 俞春华 +1 位作者 訾扬 谢铎 《信息通信》 2013年第1期61-62,共2页
首先介绍了低压差分信号、光纤传输的一般原理,然后提出了一种基于FPGA的多通道高速光电接口模块设计方法,从模块的原理设计、印制板设计、FPGA设计等多个方面进行了分析。最后对基于FPGA的高速串行数据接口进行了测试验证。
关键词 高速串行数据传输 低压差分信号 光纤传输 现场可编程门阵列
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基于PCI的高速数字信号发生卡设计 被引量:3
15
作者 羌凌飞 《电子测量技术》 2009年第9期1-3,7,共4页
本文以高速串行测试信号传输为例,介绍了基于PCI总线的高速数字信号发生卡的设计方法。信号发生卡的数据存储在PC机硬盘中,通过PCI总线将待发送数据写入在发生卡的存储设备SRAM中,在FPGA的逻辑控制下,并串变化或通过转换芯片后以串行的... 本文以高速串行测试信号传输为例,介绍了基于PCI总线的高速数字信号发生卡的设计方法。信号发生卡的数据存储在PC机硬盘中,通过PCI总线将待发送数据写入在发生卡的存储设备SRAM中,在FPGA的逻辑控制下,并串变化或通过转换芯片后以串行的方式高速的输出为设备测试提供标准或非标高速测试数字信号。本文从硬件设计,FPGA设计以及驱动开发3个方面详细阐述了信号发生卡的设计方法。该信号卡已运用于工程实践中,为设备测试提供准确的异步串行以及高达百兆的非标串行数字测试信号。 展开更多
关键词 信号发生卡 高速串行测试数据 PCI 驱动开发 FPGA
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IEEE 1394应用于航空电子系统图像通信的研究 被引量:13
16
作者 王苗苗 张春熹 史洁琴 《微计算机信息》 北大核心 2006年第04S期225-227,304,共4页
IEEE1394是一种新型的高速串行数据总线,它提供的等时数据传输模式可认为是目前比较理想的解决数字视频图像通信的方案之一。阐述了1394的总体性能特点,从航空电子系统数据通信的需求出发,分析将1394应用到航空电子系统视频图像通信的... IEEE1394是一种新型的高速串行数据总线,它提供的等时数据传输模式可认为是目前比较理想的解决数字视频图像通信的方案之一。阐述了1394的总体性能特点,从航空电子系统数据通信的需求出发,分析将1394应用到航空电子系统视频图像通信的可行性,并通过实验进行验证。实验结果表明,IEEE1394能够满足新一代航电系统大容量数据实时传输的需求。 展开更多
关键词 IEEE 1394 数字视频图像通信 航空电子系统 高速串行数据总线
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重离子加速器数字电源回读系统 被引量:1
17
作者 张华剑 吴凤军 +4 位作者 黄玉珍 高大庆 陈皓 张帅 崔渊 《原子能科学技术》 EI CAS CSCD 北大核心 2018年第6期1132-1138,共7页
为提高数字电源回读数据的精确性、抑制噪声、降低成本,开发设计了全数字化回读系统。在本系统中,发送端的数字电源控制器通过光纤模块,按专用协议以2kHz频率发送4种数据;接收端的数字信号采集设备接收、存储每台电源的回读数据,并标记... 为提高数字电源回读数据的精确性、抑制噪声、降低成本,开发设计了全数字化回读系统。在本系统中,发送端的数字电源控制器通过光纤模块,按专用协议以2kHz频率发送4种数据;接收端的数字信号采集设备接收、存储每台电源的回读数据,并标记以时间戳。系统采用有效机制保证每条数据通路的时钟同步,并提供了数据分析图形化界面。经现场测试,验证了系统的性能,达到了设计目的,使全数字化回读首次在重离子医用加速器励磁电源系统上得到成功应用。基于其较好的抗干扰性和经济性,未来可在重离子加速器中推广应用。 展开更多
关键词 数字电源回读系统 高速串行数据传输 数据时间戳 海量数据处理 重离子加速器
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Performance Evaluation of IEEE 1394b Serial Bus with Deterministic and Stochastic Petri Nets 被引量:4
18
作者 王明 张春熹 伊小素 《China Communications》 SCIE CSCD 2013年第2期121-133,共13页
IEEE 1394b is a high-speed data bus that is widely used in local area networks and consumer electronics. To best utilize this data bus, we need to fully understand its per- formance. To evaluate its performance for bo... IEEE 1394b is a high-speed data bus that is widely used in local area networks and consumer electronics. To best utilize this data bus, we need to fully understand its per- formance. To evaluate its performance for both isochronous and asynchronous data transfers, we model the IEEE 1394b bus using Deterministic and Stochastic Pelri Nets (DSPNs), and conduct simulations using TimeNET 4.0. Using the DSPNs model, we simulate both the average waiting times of isochronous and asynchronous packets. From the simulation results, we determine the factors that influence performance, such as throughput, size of packets, arrival rate of packets, number of isochronous channels, and bus configuration. 展开更多
关键词 performance evaluation IEEE1394B isochronous data transfer asynchro-nous data transfer
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一种新的8B/10B编码电路设计 被引量:8
19
作者 刘智 宁红英 王普昌 《通信技术》 2009年第7期60-61,84,共3页
高速串行数据传输中广泛采用8B/10B编码。为得到结构简单、易于大规模集成的编码电路,文中在深入分析8B/10B编码内在相关性和逻辑关系的基础上,采用ECL结构和0.6μm BiCMOS工艺,设计了8B/10B编码电路。并将该编码电路应用于传输速率400M... 高速串行数据传输中广泛采用8B/10B编码。为得到结构简单、易于大规模集成的编码电路,文中在深入分析8B/10B编码内在相关性和逻辑关系的基础上,采用ECL结构和0.6μm BiCMOS工艺,设计了8B/10B编码电路。并将该编码电路应用于传输速率400Mb/s的高速串行数据发送器中。与现有8B/10B编码方法相比,仿真结果表明采用该方法实现的编码电路逻辑运算量小、速度快;实测结果表明该编码电路具有误码率低、可靠性高等优点。 展开更多
关键词 8B/10B编码 数据极性 高速串行数据发送器
原文传递
通向快速数字化测试的解决方案——泰克实时频谱分析仪及其在RFID测试中的应用
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作者 本刊记者 《射频世界》 2007年第2期16-19,共4页
为了更好地推进各类数字RF应用的测试工作,泰克公司举行新闻发布会,推出了AWG5000任意波形发生器。最新的AWG5000可以满足客户的需求,提高了测试效率,降低了测试成本,为各类数字RF技术的验证提供了理想的选择。泰克公司推出的超高性能DS... 为了更好地推进各类数字RF应用的测试工作,泰克公司举行新闻发布会,推出了AWG5000任意波形发生器。最新的AWG5000可以满足客户的需求,提高了测试效率,降低了测试成本,为各类数字RF技术的验证提供了理想的选择。泰克公司推出的超高性能DSA70000系列实时频谱分析仪和业界速度最高的多功能探头P7500,构成了新一代高速串行数据测试平台的核心。这样,数字新世界的研发工程师们将拥有更快解决难题、加速将创新推向市场的能力。泰克公司还致力于RFID测试需求的研究,将实时频谱分析仪应用于RFID测试,为RFID测试人员提供了非常方便的测试手段。 展开更多
关键词 泰克公司 数字RF技术 高速串行数据测试平台 射频识别
原文传递
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