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高吞吐率浮点FFT处理器的FPGA实现研究
被引量:
5
1
作者
牟胜梅
杨晓东
《计算机工程与科学》
CSCD
2008年第7期98-99,117,共3页
受浮点操作的长流水线延迟及FPGA片上RAM端口数目的限制,传统FFT处理器的吞吐率通常只能达到每周期输出一个复数结果。本文用FPGA设计并实现了一种高吞吐率的IEEE754标准单精度浮点FFT处理器,通过改进蝶形计算单元的结构并重新组织FPGA...
受浮点操作的长流水线延迟及FPGA片上RAM端口数目的限制,传统FFT处理器的吞吐率通常只能达到每周期输出一个复数结果。本文用FPGA设计并实现了一种高吞吐率的IEEE754标准单精度浮点FFT处理器,通过改进蝶形计算单元的结构并重新组织FPGA片上RAM的访问,该处理器每周期平均可输出约两个复数计算结果,吞吐率约为传统FFT处理器吞吐率的两倍。对于1024点FFT变换,可在(512+10)*10=5220周期内完成。
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关键词
FPGA
FFT蝶形单元
3输入浮点加法器
下载PDF
职称材料
题名
高吞吐率浮点FFT处理器的FPGA实现研究
被引量:
5
1
作者
牟胜梅
杨晓东
机构
国防科技大学计算机学院
出处
《计算机工程与科学》
CSCD
2008年第7期98-99,117,共3页
文摘
受浮点操作的长流水线延迟及FPGA片上RAM端口数目的限制,传统FFT处理器的吞吐率通常只能达到每周期输出一个复数结果。本文用FPGA设计并实现了一种高吞吐率的IEEE754标准单精度浮点FFT处理器,通过改进蝶形计算单元的结构并重新组织FPGA片上RAM的访问,该处理器每周期平均可输出约两个复数计算结果,吞吐率约为传统FFT处理器吞吐率的两倍。对于1024点FFT变换,可在(512+10)*10=5220周期内完成。
关键词
FPGA
FFT蝶形单元
3输入浮点加法器
Keywords
FPGA
FFT
butterfly unit
3
-input floating-point adder
分类号
TP302 [自动化与计算机技术—计算机系统结构]
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题名
作者
出处
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被引量
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1
高吞吐率浮点FFT处理器的FPGA实现研究
牟胜梅
杨晓东
《计算机工程与科学》
CSCD
2008
5
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