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以太网中8位并行CRC-32软核设计 被引量：5
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作者 李宥谋 《西安邮电学院学报》 2006年第5期32-35,共4页
研究以太网系统中帧校验序列(FCS)的并行处理方法。根据串行CRC-32编码原理,导出并行CRC-32编码算法,并且给出Verilog HDL语言设计的并行CRC-32软核。使其能够方便、灵活的应用到高速以太网系统设计中。
关键词 CRC码 crc-32软核 VERILOG HDL语言
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