基于Chipyard的RISC⁃V处理器设计与实现

芯片设计领域的RISC⁃V较ARM、X86和PowerPC等主流指令集架构有着精简、开源和灵活的明显优势。利用Chipyard框架采用Chisel语言设计了五级流水线的RISC⁃V处理器兼具开发周期短和保留RISC⁃V的架构优势。其中,存储器管理单元(MMU)支持页面的虚拟内存和无阻塞数据缓存,并具备分支预测、浮点运算等功能,在FPGA上完成软硬件协同仿真。实验表明,基于Chipyard设计的RISC⁃V处理器支持RV64GC指令集集合,Dhrystone跑分达到1.27 DMIPS/MHz。