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DS/FH混合扩频接收机解扩及同步技术的FPGA实现 被引量:6
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作者 刘继承 邵定蓉 +1 位作者 李暑坚 朱进洲 《电子技术应用》 北大核心 2003年第1期56-59,共4页
研究采用编码扩频的DS/FH混合扩频接收机的核心模块——同步及解扩部分的FPGA实现结构。将多种专用芯片的功能集成在一片大规模FPGA芯片上,实现了接收机的高度集成化、小型化。伪码的串并混合捕获算法及跳频同步算法等均采用硬件完成,... 研究采用编码扩频的DS/FH混合扩频接收机的核心模块——同步及解扩部分的FPGA实现结构。将多种专用芯片的功能集成在一片大规模FPGA芯片上,实现了接收机的高度集成化、小型化。伪码的串并混合捕获算法及跳频同步算法等均采用硬件完成,提高了捕获速度。实验结果证明该方案是正确可行的。 展开更多
关键词 混合扩频 ds/fh接收机 解扩 同步 FPGA实现
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