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基于Single-Sequence表示法的BUS总线约束布局优化
1
作者
李康
《电脑知识与技术》
2018年第11X期225-226,共2页
基于Single-Sequence表示法和模拟退火算法框架,通过检验single-sequence编码的直接升序和直接降序判断BUS总线布局中水平和垂直约束的可行性。在MCNC benchmark上的实验结果验证了算法的有效性.。
关键词
single-sequence
表示法
BUS布局约束
直接升序
直接降序
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职称材料
基于Single-Sequence布图规划边界约束问题的研究
2
作者
沈利
刘陈
赵华安
《电脑知识与技术》
2007年第10期247-248,264,共3页
布图规划是VLSI设计中非常重要的步骤。在计算机辅助设计中,布图被表示成编码以使其容易被计算机处理。Single-Sequence就是一种非常有用的表示布图的编码方法。一个布图中,一些模块如输入输出模块,必须放置在芯片的边界处,这种限制被...
布图规划是VLSI设计中非常重要的步骤。在计算机辅助设计中,布图被表示成编码以使其容易被计算机处理。Single-Sequence就是一种非常有用的表示布图的编码方法。一个布图中,一些模块如输入输出模块,必须放置在芯片的边界处,这种限制被称为边界约束。本论文提出了用模拟退火算法寻求最优布图的方法,有效地解决了布图规划的边界约束问题。
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关键词
VLSI
布图规划
模拟退火
single-sequence
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职称材料
一种超大规模集成电路多层布线技术研究
3
作者
石海波
《煤炭技术》
CAS
北大核心
2010年第11期24-26,共3页
当前芯片里的电路与系统日趋复杂,超大规模集成电路(VLSI)设计技术水平也在逐渐提高。VLSI设计中一般采用分级设计的方法。布图设计过程是整个VLSI分级设计中非常关键的步骤之一。基于Single-Sequence的集成电路布图就是在SS编解码的应...
当前芯片里的电路与系统日趋复杂,超大规模集成电路(VLSI)设计技术水平也在逐渐提高。VLSI设计中一般采用分级设计的方法。布图设计过程是整个VLSI分级设计中非常关键的步骤之一。基于Single-Sequence的集成电路布图就是在SS编解码的应用下对芯片中各单元的摆放进行优化从而达到芯片面积利用率最大化。重点介绍了在SS序列生成版图后各单元间连线的设计以及如何根据水平/垂直约束图提取版图中各单元的坐标,并利用李氏算法查找出最佳布线路径。
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关键词
single-sequence
水平/垂直约束图
李氏算法
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职称材料
题名
基于Single-Sequence表示法的BUS总线约束布局优化
1
作者
李康
机构
四川交通职业技术学院交通运输研究所
出处
《电脑知识与技术》
2018年第11X期225-226,共2页
基金
四川省教育厅自然科学研究项目
(项目编号:08ZA138)资金支持
文摘
基于Single-Sequence表示法和模拟退火算法框架,通过检验single-sequence编码的直接升序和直接降序判断BUS总线布局中水平和垂直约束的可行性。在MCNC benchmark上的实验结果验证了算法的有效性.。
关键词
single-sequence
表示法
BUS布局约束
直接升序
直接降序
分类号
TN40 [电子电信—微电子学与固体电子学]
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职称材料
题名
基于Single-Sequence布图规划边界约束问题的研究
2
作者
沈利
刘陈
赵华安
机构
南京邮电大学
日本国立熊本大学
出处
《电脑知识与技术》
2007年第10期247-248,264,共3页
文摘
布图规划是VLSI设计中非常重要的步骤。在计算机辅助设计中,布图被表示成编码以使其容易被计算机处理。Single-Sequence就是一种非常有用的表示布图的编码方法。一个布图中,一些模块如输入输出模块,必须放置在芯片的边界处,这种限制被称为边界约束。本论文提出了用模拟退火算法寻求最优布图的方法,有效地解决了布图规划的边界约束问题。
关键词
VLSI
布图规划
模拟退火
single-sequence
Keywords
VLSI
Floorplanning
Simulated Annealing
single-sequence
分类号
TP391 [自动化与计算机技术—计算机应用技术]
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职称材料
题名
一种超大规模集成电路多层布线技术研究
3
作者
石海波
机构
江苏大学
出处
《煤炭技术》
CAS
北大核心
2010年第11期24-26,共3页
文摘
当前芯片里的电路与系统日趋复杂,超大规模集成电路(VLSI)设计技术水平也在逐渐提高。VLSI设计中一般采用分级设计的方法。布图设计过程是整个VLSI分级设计中非常关键的步骤之一。基于Single-Sequence的集成电路布图就是在SS编解码的应用下对芯片中各单元的摆放进行优化从而达到芯片面积利用率最大化。重点介绍了在SS序列生成版图后各单元间连线的设计以及如何根据水平/垂直约束图提取版图中各单元的坐标,并利用李氏算法查找出最佳布线路径。
关键词
single-sequence
水平/垂直约束图
李氏算法
Keywords
single-sequence
level/vertical constraint graph
Lee's algorithm
分类号
TN40 [电子电信—微电子学与固体电子学]
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职称材料
题名
作者
出处
发文年
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1
基于Single-Sequence表示法的BUS总线约束布局优化
李康
《电脑知识与技术》
2018
0
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职称材料
2
基于Single-Sequence布图规划边界约束问题的研究
沈利
刘陈
赵华安
《电脑知识与技术》
2007
0
下载PDF
职称材料
3
一种超大规模集成电路多层布线技术研究
石海波
《煤炭技术》
CAS
北大核心
2010
0
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职称材料
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