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ANSYS在VLSI互连模拟中的应用 被引量:2
1
作者 阮刚 梁庆龙 +3 位作者 ReinhardStreiter 宋任儒 ThomasOtto ThomasGessner 《半导体技术》 CAS CSCD 北大核心 2000年第1期53-56,共4页
介绍了ANSYS程序在VLSI互连几何最佳化设计中的初步应用。应用表明:ANSYS的模拟精度高,图形显示功能强。应用ANSYS自动寻优功能使RC延迟最佳化几何参数的寻找较为迅速和直观。
关键词 集成电路 互连模拟 ansys模拟程序 vlsi
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VLSI电路中互连线特性研究及其数值模拟 被引量:2
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作者 阮刚 肖夏 +3 位作者 ReinhardStreiter 宋任儒 ThomasOtto ThomasGessner 《微电子学》 CAS CSCD 北大核心 2000年第1期1-4,7,共5页
用数值计算方法详细模拟了室温及低温(77K)下VLSI电路中金属互连线的寄生电容和时间延迟,得到了金属互连线的几何结构对寄生效应的影响。结果表明,互连线宽W同互连线节距P之比为0.5~0.6是获得最小时间延迟的最佳尺寸。模拟还给出了用... 用数值计算方法详细模拟了室温及低温(77K)下VLSI电路中金属互连线的寄生电容和时间延迟,得到了金属互连线的几何结构对寄生效应的影响。结果表明,互连线宽W同互连线节距P之比为0.5~0.6是获得最小时间延迟的最佳尺寸。模拟还给出了用铜代替铝金属线及用低介电常数电介质(εlow-k=0.5εSiO2)代替SiO2后。 展开更多
关键词 集成电路 互连线 数值模拟 vlsi
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一种用于模拟高速VLSI中互连线瞬态响应的高效数值方法 被引量:3
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作者 李鸿儒 李征帆 《上海交通大学学报》 EI CAS CSCD 北大核心 2001年第6期817-819,825,共4页
利用线性多步积分法分析了高速 VLSI中互连线的瞬态响应问题 .与传统的差分方法相比 ,本算法具有高效、高精度、占计算机内存少等优点 ;另外 ,由于本算法是直接的数值算法 ,所以在处理互连线问题时 ,不受条件限制 。
关键词 高速大规模集成电路 互连线 线性多步积分法 瞬态响应 数值模拟 响应分析
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用MatLab仿真高阶RC模型的互连线特性 被引量:5
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作者 袁宝国 章文斌 +1 位作者 冯培昌 靳炜 《系统仿真学报》 CAS CSCD 2004年第6期1220-1221,1224,共3页
用MatLab软件,对超大规模集成电路互连线的高阶王氏RC梯形电路模型在时域和频域进行仿真。结果显示,①100阶模型与2000阶模型单位阶跃响应0.9的上升时间仅相差9.5‰,表明用100阶模型仿真已足够精确。②通过仿真,确定了一个来自实际的互... 用MatLab软件,对超大规模集成电路互连线的高阶王氏RC梯形电路模型在时域和频域进行仿真。结果显示,①100阶模型与2000阶模型单位阶跃响应0.9的上升时间仅相差9.5‰,表明用100阶模型仿真已足够精确。②通过仿真,确定了一个来自实际的互连线的通频带宽度。③测定了分布电阻和分布电容对互连线阶跃响应的上升时间及其通频带宽度的影响。④高阶仿真结果与1阶模型的理论结果相比,定性描述相同,定量描述差异较大,因此,用高阶模型对互连线的分布电路性质进行准确描述有一定的必要。 展开更多
关键词 计算机仿真 超大规模集成电路 互连线 分布电路 状态空间方程
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一种基于概率解释的新型互连线时延Slew模型 被引量:3
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作者 周磊 孙玲玲 +2 位作者 严晓浪 陈偕雄 蒋立飞 《电路与系统学报》 CSCD 北大核心 2009年第2期7-11,共5页
基于概率解释的互连线时延模型具有效率高,实现简单,估计准确等特点,在亚100纳米工艺IC设计及验证中具有较好的应用前景。基于概率解释的互连线时延模型往往需要大量的查表计算,对效率及计算精度都存在一定的影响,而且有些模型不能进行S... 基于概率解释的互连线时延模型具有效率高,实现简单,估计准确等特点,在亚100纳米工艺IC设计及验证中具有较好的应用前景。基于概率解释的互连线时延模型往往需要大量的查表计算,对效率及计算精度都存在一定的影响,而且有些模型不能进行Slew的估计。本文提出了一种基于BS统计分布的互连线时延模型,完全避免了查表运算而且可直接用于Slew估计。90纳米工艺TCAD仿真实验结果表明,该模型在效率、精度、实现难易程度等方面具有一定的优势,对亚100纳米VLSI静态时序分析及相关EDA工具开发也有一定的参考价值。 展开更多
关键词 超大规模集成电路 互连线 概率分布函数 仿真
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基于FPGA的IP仿真验证平台(英文) 被引量:4
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作者 郑学仁 邓婉玲 +3 位作者 范健明 陈玲晶 陈国辉 林晓伟 《华南理工大学学报(自然科学版)》 EI CAS CSCD 北大核心 2006年第1期38-42,共5页
IP(集成电路知识产权芯核)的仿真和硬件验证是IP开发中不可缺少的环节.文中基于FPGA(现场可编程门阵列)开发了一个IP仿真验证平台,并使用PCI(外部设备互连)总线来测试IP.用户只要将自己设计的IP插入所开发的仿真验证平台,就可以方便地... IP(集成电路知识产权芯核)的仿真和硬件验证是IP开发中不可缺少的环节.文中基于FPGA(现场可编程门阵列)开发了一个IP仿真验证平台,并使用PCI(外部设备互连)总线来测试IP.用户只要将自己设计的IP插入所开发的仿真验证平台,就可以方便地对IP进行测试.文中还对所设计的平台进行了软件仿真,以验证其功能,并在载有Xilinx spartan-3 600E FPGA的PCI插卡上进行上板调试.结果表明,所建立的基于FPGA的IP仿真验证平台可以对IP进行有效的仿真和验证,并具有良好的稳定性和实用价值. 展开更多
关键词 现场可编程门阵列 集成电路知识产权芯核 仿真 验证 外部设备互连
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传输线瞬态分析中基于电报方程时-空离散的有效方法 被引量:14
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作者 郭裕顺 《电子学报》 EI CAS CSCD 北大核心 2001年第3期373-377,共5页
本文对基于电报方程时 空变量同时离散的传输线瞬态分析方法作了重新研究 .利用传输线上电压电流的波动传播特性 ,导出了有效的传输线瞬态分析模型 ;提出了用Lax Friedrichs差分格式消除因空间坐标离散化导致的解的寄生振荡的方法 ;给... 本文对基于电报方程时 空变量同时离散的传输线瞬态分析方法作了重新研究 .利用传输线上电压电流的波动传播特性 ,导出了有效的传输线瞬态分析模型 ;提出了用Lax Friedrichs差分格式消除因空间坐标离散化导致的解的寄生振荡的方法 ;给出了模型在一般电路模拟器中的变步长实现 ;最后用实例作了验证 .通过这些工作说明这一原始而基本的方法事实上可应用于最一般的非均匀频变传输线 。 展开更多
关键词 传输线分析 电报方程 时-空离散 集成电路
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互连线分布电路阶跃响应上升时间的精确推算 被引量:2
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作者 袁宝国 唐国春 《计算机仿真》 CSCD 2004年第8期88-90,共3页
采用MatLab软件对Wang[1]氏公式编程,对互连线1阶至2000阶RC梯形电路模型进行仿真,精确地推得其分布电路单位阶跃响应的上升时间,从而使低阶模型阶跃响应上升时间的误差估计有了科学依据。结果表明,16阶以下的低阶RC梯形电路模型误差大... 采用MatLab软件对Wang[1]氏公式编程,对互连线1阶至2000阶RC梯形电路模型进行仿真,精确地推得其分布电路单位阶跃响应的上升时间,从而使低阶模型阶跃响应上升时间的误差估计有了科学依据。结果表明,16阶以下的低阶RC梯形电路模型误差大于5%,20阶误差为5%,100阶的误差约1%。结果对超大规模集成电路设计中互连线RC梯形电路低阶模型阶数的确定及其误差修正提供依据。 展开更多
关键词 超大规模集成电路 互连线时延 仿真 状态方程
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微分求积法求解高速大规模集成电路互连线的瞬态响应 被引量:2
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作者 徐勤卫 李征帆 陈文 《电路与系统学报》 CSCD 1998年第2期76-81,共6页
本文将微分求积法(DQ方法)应用于高速大规模集成电路互连线的瞬态模拟。DQ方法是一种直接的数值方法 ,与差分和有限元法相比 ,它的计算量可以大大降低 ,且具有较高的精度。DQ方法的主要思想是将某坐标方向上的微分算子用该方向上一系列... 本文将微分求积法(DQ方法)应用于高速大规模集成电路互连线的瞬态模拟。DQ方法是一种直接的数值方法 ,与差分和有限元法相比 ,它的计算量可以大大降低 ,且具有较高的精度。DQ方法的主要思想是将某坐标方向上的微分算子用该方向上一系列适当的离散点的函数值加权逼近 ,将偏微分方程化为常微分方程或代数方程求解。DQ方法用于高速大规模集成电路互连线系统的瞬态模拟非常有效 。 展开更多
关键词 微分求积法 vlsi 互连线系统
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互连线RC模型应用条件的仿真研究 被引量:4
10
作者 袁宝国 王胜国 《电路与系统学报》 CSCD 2004年第1期139-141,共3页
研究结果表明,在L与RC比值较小时,阶跃响应的上升时间基本上由RC的乘积决定,电感对电路的影响可以忽略,互连线采用RC模型与RLC模型结果应无多大差别。在L与RC比值较大时,阶跃响应曲线出现振荡,此时使用RC模型需满足工作频率低于RC模型... 研究结果表明,在L与RC比值较小时,阶跃响应的上升时间基本上由RC的乘积决定,电感对电路的影响可以忽略,互连线采用RC模型与RLC模型结果应无多大差别。在L与RC比值较大时,阶跃响应曲线出现振荡,此时使用RC模型需满足工作频率低于RC模型的“上限使用频率;当工作频率超过RC模型的“上限使用频率”时,互连线的模型就必须采用RLC模型。RC模型的“上限使用频率”仅与互连线长度有关:fmax106(Hz·m)。 展开更多
关键词 超大规模集成电路 互连线 仿真 电路模型
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带钢表面氧化层湿式抛丸清理技术 被引量:5
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作者 高志 卜银剑 《中国表面工程》 EI CAS CSCD 北大核心 2015年第2期114-120,共7页
目前绝大部分钢铁公司带钢表面氧化层的清理主要通过酸洗工艺或干式抛丸设备,然而这些表面处理工艺存在污染环境,过酸洗,灰尘、弹丸分离效果差,带钢表面划痕明显等问题。文中分析、整合了抛丸和喷丸技术的环境污染小,带钢表面无划痕,抛... 目前绝大部分钢铁公司带钢表面氧化层的清理主要通过酸洗工艺或干式抛丸设备,然而这些表面处理工艺存在污染环境,过酸洗,灰尘、弹丸分离效果差,带钢表面划痕明显等问题。文中分析、整合了抛丸和喷丸技术的环境污染小,带钢表面无划痕,抛丸参数可控、易调节,不会过清理等优点,在常规抛丸设备中引入水系统,提出了一种湿式抛丸处理工艺,开发了一台湿式抛丸设备。通过PLC及触摸屏人机控制,完成了抛丸设备抛丸器,带钢移动小车,斗式提升机等不同部件的协调运动。利用有限元软件ANSYS/LS-DYNA进行动力学仿真,分析并优化了抛丸参数对带钢表面性能的影响关系。试验表明,湿式抛丸可以有效清除带钢表面氧化层,并且与酸洗和干式抛丸相比,有一定的优越性。 展开更多
关键词 湿式抛丸 可编程逻辑控制器(PLC) 触摸屏 ansys/LS-DYNA 动力学仿真
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门电路参数对互连线时延影响的仿真研究 被引量:2
12
作者 袁宝国 《微电子学与计算机》 CSCD 北大核心 2004年第6期178-181,184,共5页
文章推广了Wang氏RC梯形电路模型,对互连线阶跃响应上升时间与门电路参数的关系进行了仿真研究,给出了定量结果。门电路参数有输出电阻、输入电阻和电容。
关键词 计算机仿真 MATLAB 超大规模集成电路 互连线 状态方程
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高速集成电路芯片内互连线的计算机辅助分析
13
作者 袁正宇 李征帆 《半导体情报》 2000年第1期30-34,共5页
分析了高速集成电路芯片内互连线的时域特性。首先运用全波方法提取互连线的频变等效电路参数。在此基础上运用数值反拉普拉斯变换 ( NILT)法分析互连电路的时域响应。在分析过程中 ,提出或运用了一些提高精度或效率的技术和方法。分析... 分析了高速集成电路芯片内互连线的时域特性。首先运用全波方法提取互连线的频变等效电路参数。在此基础上运用数值反拉普拉斯变换 ( NILT)法分析互连电路的时域响应。在分析过程中 ,提出或运用了一些提高精度或效率的技术和方法。分析结果表明 ,该方法很适合高速集成电路芯片内互连线的计算机辅助分析。 展开更多
关键词 高速集成电路 互连线 CAE
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一种多路射频电连接器的结构设计
14
作者 石承伟 陈侃 程德帅 《科技创新与应用》 2019年第32期96-98,共3页
随着军用电子装备的发展,整机设备中的集成度越来越高,集束多路射频电连接器作为快速互联元器件,逐渐成为整机装备需求的热点之一。文章以某机载雷达项目的使用需求作为依托,针对多路射频电连接器小体积、多功能化、可单路更换调试的使... 随着军用电子装备的发展,整机设备中的集成度越来越高,集束多路射频电连接器作为快速互联元器件,逐渐成为整机装备需求的热点之一。文章以某机载雷达项目的使用需求作为依托,针对多路射频电连接器小体积、多功能化、可单路更换调试的使用要求,设计出一种结构新颖的可互联互换多路射频电连接器,通过理论计算和ANSYS软件仿真,对产品进行设计和优化,验证结构的合理性。 展开更多
关键词 集束多路 射频连接器 互联互换 模块化 ansys仿真
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TRANSIENT ANALYSIS OF TRANSMISSION LINE CIRCUITS BASED ON THE SEMIDISCRETIZATION OF TELEGRAPH EQUATIONS
15
作者 Guo Yushun(Hangzhou Institute of Electronic Engineering, Hangzhou 310037) 《Journal of Electronics(China)》 2001年第1期46-55,共10页
A new transient analysis method for the transmission line circuits is presented in this paper. Based on the semidiscretization of the telegraph equations, a discretized time domain companion models for the transmissio... A new transient analysis method for the transmission line circuits is presented in this paper. Based on the semidiscretization of the telegraph equations, a discretized time domain companion models for the transmission lines which can be conveniently implemented in a general circuit simulator such as SPICE is derived. The computation required for the model is linear with time, equivalent to the recursive convolution-based method. The formulations for both single and coupled lossy transmission lines are given. Numerical experiments are carried out to demonstrate the validity of the method. 展开更多
关键词 vlsi interconnects Transmission LINE analysis CIRCUIT simulation
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Efficient Clustering and Simulated Annealing Approach for Circuit Partitioning
16
作者 SANDEEP Singh Gill RAJEEVAN Chandel ASHWANI Kumar Chandel 《Journal of Shanghai Jiaotong university(Science)》 EI 2011年第6期708-712,共5页
Circuit net list bipartitioning using simulated annealing technique has been proposed in the paper.The method converges asymptotically and probabilistically to global optimization.The circuit net list is partitioned i... Circuit net list bipartitioning using simulated annealing technique has been proposed in the paper.The method converges asymptotically and probabilistically to global optimization.The circuit net list is partitioned into two partitions such that the number of interconnections between the partitions is minimized.The proposed method begins with an innovative clustering technique to obtain a good initial solution.Results obtained show the versatility of the proposed method in solving non polynomial hard problems of circuit net list partitioning and show an improvement over those available in literature. 展开更多
关键词 cut size non polynomial hard partitioning simulated annealing interconnectIONS very large scale integration(vlsi) design
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New Multipole Method for 3-D Capacitance Extraction
17
作者 Zhao-ZhiYang Ze-YiWang 《Journal of Computer Science & Technology》 SCIE EI CSCD 2004年第4期544-549,共6页
This paper describes an efficient improvement of the multipole accelerated boundary element method for 3-D capacitance extraction. The overall relations between the positions of 2-D boundary elements are considered in... This paper describes an efficient improvement of the multipole accelerated boundary element method for 3-D capacitance extraction. The overall relations between the positions of 2-D boundary elements are considered instead of only the relations between the center-points of the elements, and a new method of cube partitioning is introduced. Numerical results are presented to demonstrate that the method is accurate and has nearly linear computational growth as O(n), where n is the number of panels/boundary elements. The proposed method is more accurate and much faster than Fastcap. 展开更多
关键词 3-D interconnect parasitic capacitance extraction IBEM (indirect boundary element method) electronic design automation parasitic parameter extraction vlsi simulation verification
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