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基于FPGA的Kohonen竞争网络硬件实现
1
作者
孙永刚
孙一康
孙昂
《微计算机信息》
2004年第11期35-36,共2页
本文介绍了神经网络VLSI硬件实现的基本情况和VerilgHDL硬件设计方法的概念,在此基础上利用FPGA设计出了Kohonen竞争网络硬件电路,其工作频率为33Mhz,并对其工作过程进行了较详细的分析,给出了综合仿真的测试结果。
关键词
神经网络硬件实现
Kohonen竞争网络算法
verilghdl
FPGA
下载PDF
职称材料
题名
基于FPGA的Kohonen竞争网络硬件实现
1
作者
孙永刚
孙一康
孙昂
机构
北京科技大学信息工程学院
出处
《微计算机信息》
2004年第11期35-36,共2页
文摘
本文介绍了神经网络VLSI硬件实现的基本情况和VerilgHDL硬件设计方法的概念,在此基础上利用FPGA设计出了Kohonen竞争网络硬件电路,其工作频率为33Mhz,并对其工作过程进行了较详细的分析,给出了综合仿真的测试结果。
关键词
神经网络硬件实现
Kohonen竞争网络算法
verilghdl
FPGA
Keywords
neural network hardware realization
Kohonen competitive network arithmetic
verilghdl
FPGA
分类号
TP273.4 [自动化与计算机技术—检测技术与自动化装置]
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题名
作者
出处
发文年
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1
基于FPGA的Kohonen竞争网络硬件实现
孙永刚
孙一康
孙昂
《微计算机信息》
2004
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