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K=9卷积码的Viterbi译码算法及其FPGA实现 被引量：8
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作者 胡爱群 庞康 苏杰 《应用科学学报》 CAS CSCD 1998年第2期149-156,共8页
探讨了ＣＤＭＡ数字移动通信中的差错控制问题，研究用约束度Ｋ＝９的卷积编码和最大似然Ｖｉｔｅｒｂｉ译码的差错控制方案．在Ｖｉｔｅｒｂｉ译码算法中，提出了原位运算度量、保存路径转移过程和循环存取幸存路径等方法，能有效地减... 探讨了ＣＤＭＡ数字移动通信中的差错控制问题，研究用约束度Ｋ＝９的卷积编码和最大似然Ｖｉｔｅｒｂｉ译码的差错控制方案．在Ｖｉｔｅｒｂｉ译码算法中，提出了原位运算度量、保存路径转移过程和循环存取幸存路径等方法，能有效地减少存储量、降低功耗，使得Ｋ＝９的Ｖｉｔｅｒｂｉ译码算法可在以单片ＸＣ４０１０ＦＰＧＡ为主的器件上实现，其性能指标符合ＣＤ－ＭＡ数字移动通信ＩＳ９５标准要求．文中给出了实测的算法性能，讨论了ＦＰＧＡ具体实现问题． 展开更多
关键词 数字移动通信 viterbi译译 FPGA实现 卷积码
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