GF（2^m）域乘法器的快速设计及FPGA实现

有限域GF(2m)上的椭圆曲线密码体制以其密钥短、安全强度高的优点获得了广泛的重视和应用,该密码体制最主要的运算是有限域上的乘法运算。该文提出一种基于FPGA技术的多项式基乘法器的快速设计方法,并给出了面积与速度的比较分析。

基于FPGA技术的GF（2^m）域乘法器的研究和设计

椭圆曲线密码体制以其密钥短、安全强度高的优点获得了广泛的重视和应用,而GF(2m)有限域乘法运算是该密码体制最主要的运算。本文研究了基于FPGA芯片的多项式基乘法器的快速设计方法,并给出了面积与速度的比较和分析。

基于FPGA自适应高速RS编译码器的IP核设计

针对 IP核设计方法讨论了一种可动态配置编码方案的高吞吐率 RS编译码器。该编译码器采用Euclid算法实现译码 ,编译码过程采用流水线结构提高速率。整个设计使用 VHDL语言描述 ,并在 Xilinx公司的

EMCCD时序发生器的VHDL设计

具有电子倍增功能的CCD图像传感器在微光探测与成像领域获得了极大的成功。分析了该TC285SPD EMCCD用于微光成像时的控制要求,并结合模拟前端信号处理器AD9845B的时序控制要求,采用VHDL语言进行编程,实现了对该EMCCD的驱动控制。详细介绍了EMCCD时序发生器的VHDL设计方法和实现过程,在QuartusII环境下给出了系统的仿真结果,并对结果进行了分析讨论。

面向全同态加密的有限域FFT算法FPGA设计

大数乘法是全同态加密算法中一个不可或缺的单元模块,也是其中耗时最多的模块,设计一个性能优良的大数乘法器有助于推进全同态加密的实用化进程。针对SSA大数乘法器的实现需求,该文采用可综合Verilog HDL语言完成了一个16×24 bit有限域FFT算法的FPGA设计,通过构建树型大数求和单元和并行化处理方法有效提高了FFT算法的速度。与VIM编译环境下的系统级仿真结果比较,验证了有限域FFT算法FPGA设计的正确性。

高速FIR滤波器设计与FPGA实现

文章主要研究了基于传统的乘累加(MAC)结构的FIR滤波器设计的2种方法,在此基础上研究了一种新的基于分布式算法(DA)的FIR滤波器设计的硬件结构,分析了DA算法结构较MAC结构的优点。最后设计了一个8阶8 bits的基于DA结构的FIR低通滤波器,并在Altera FPGA上进行硬件实现。

基于FPGA的数控折边机温度采集系统

针对现场可编程门阵列(FPGA)的特点,提出了一种使用超高速集成电路硬件描述语言(VHDL)有限状态机来实现串行外围设备接口(SPI)多通道采集和通过FIFO缓存采集数据存储至外部ROM的方法,设计了基于ADS7863的智能温度采集系统。实验结果表明:采用该方案能有效快速地完成折边机的智能温度数据采集与存储,验证了其可行性。

基于FPGA的MAC FIR滤波器的实现

FIR滤波器在通信、图像处理、模式识别等领域都有着广泛的应用。本文设计了基于乘累加器(Multiply Accumulation,MAC)的有限冲激响应滤波器(Finite Impulse Response Filter),介绍了其优点及详细的设计方法,并给出了基于FPGA的实现流程,最后进行了基于JTAG的硬件协同仿真验证。仿真与实验结果验证了所提出MAC FIR的正确性与有效性。

一种新型快速有限域乘法器设计实现

介绍一种新型有限域乘法器,其基本原理是引入多项式拆分概念和多项式拆分方法,将m次的多项式拆分成两个m/2次多项式分别做有限域乘法,这样可以降低乘法运算的阶数,用加法计算电路来代替。并且根据这种算法设计了新型乘法器的电路实现,将这种新型乘法器并且与比特串行乘法器的仿真结果做对比。结果表明新型的有限域乘法器达到了较高的系统数据吞吐率,可以应用于纠错系统、RS编码器和译码器中。