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A high performance HfSiON/TaN NMOSFET fabricated using a gate-last process
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作者 许高博 徐秋霞 +6 位作者 殷华湘 周华杰 杨涛 牛洁斌 余嘉晗 李俊峰 赵超 《Chinese Physics B》 SCIE EI CAS CSCD 2013年第11期536-540,共5页
A gate-last process for fabricating HfSiON/TaN n-channel metal-oxide-semiconductor-field-effect transistors (NMOSFETs) is presented. In the process, a HfSiON gate dielectric with an equivalent oxide thickness of 10 ... A gate-last process for fabricating HfSiON/TaN n-channel metal-oxide-semiconductor-field-effect transistors (NMOSFETs) is presented. In the process, a HfSiON gate dielectric with an equivalent oxide thickness of 10 ? was prepared by a simple physical vapor deposition method. Poly-Si was deposited on the HfSiON gate dielectric as a dummy gate. After the source/drain formation, the poly-Si dummy gate was removed by tetramethylammonium hydroxide (TMAH) wet-etching and replaced by a TaN metal gate. Because the metal gate was formed after the ion-implant doping activation process, the effects of the high temperature process on the metal gate were avoided. The fabricated device exhibits good electrical characteristics, including good driving ability and excellent sub-threshold characteristics. The device’s gate length is 73 nm, the driving current is 117 μA/μm under power supply voltages of VGS=VDS=1.5 V and the off-state current is only 4.4 nA/μ. The lower effective work function of TaN on HfSiON gives the device a suitable threshold voltage (~ 0.24 V) for high performance NMOSFETs. The device’s excellent performance indicates that this novel gate-last process is practical for fabricating high performance MOSFETs. 展开更多
关键词 HFSION TAN gate-last process planarization
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闸门的充水平压和持住力计算 被引量:2
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作者 张锐 《陕西水力发电》 2000年第3期48-49,共2页
闸门充水平压的必要性和充水方式的选用,文中指出各种充水方式的优缺点及使用条件,并对闸门在动力条件下关闭的持住力计算做了说明,仅供参考。
关键词 闸门 充水 持住力
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论石牌战役及其战略影响 被引量:3
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作者 阮荣华 《三峡大学学报(人文社会科学版)》 2001年第4期20-23,共4页
鄂西大会战是抗日战争时期国民党正面战场上的一次较大规模的会战。被蒋介石称为斯大林格勒的石牌,由于其特殊的地理位置而成为决定会战胜败的关键。石牌战役的胜利在抗战历史上产生了重要的战略影响。文章系统的论证了石牌战役的战略... 鄂西大会战是抗日战争时期国民党正面战场上的一次较大规模的会战。被蒋介石称为斯大林格勒的石牌,由于其特殊的地理位置而成为决定会战胜败的关键。石牌战役的胜利在抗战历史上产生了重要的战略影响。文章系统的论证了石牌战役的战略部署及其战略影响,对石牌战役进行了中肯的历史评价。 展开更多
关键词 持久战 石牌战役 战略影响 抗日战争 中国
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用于纳米器件的电子束与光学混合光刻技术 被引量:2
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作者 陈广璐 唐波 +5 位作者 唐兆云 李春龙 孟令款 贺晓彬 李俊峰 闫江 《微纳电子技术》 CAS 北大核心 2013年第6期386-390,共5页
成功开发出了一种可用于纳米结构及器件制作的电子束与光学光刻的混合光刻工艺。通过两步光刻工艺,在栅结构层上采用大小图形数据分离的方法,使用光学光刻形成大尺寸栅引出电极结构,利用电子束直写形成纳米尺寸栅结构,并通过图形转移工... 成功开发出了一种可用于纳米结构及器件制作的电子束与光学光刻的混合光刻工艺。通过两步光刻工艺,在栅结构层上采用大小图形数据分离的方法,使用光学光刻形成大尺寸栅引出电极结构,利用电子束直写形成纳米尺寸栅结构,并通过图形转移工艺解决两次光刻定义的栅结构的叠加问题。此混合光刻工艺技术可以解决纳米电子束直写光刻技术效率较低的问题,同时避免了电子束进行大面积、高密度图形曝光时产生严重邻近效应影响的问题。这项工艺技术已经应用于先进MOS器件的研发,并且成功制备出具有良好电学特性、最小栅长为26 nm的器件。 展开更多
关键词 电子束光刻(EBL) 电子束直写(EBDW) 邻近效应 混合光刻 纳米器件 后栅工艺
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22 nm FDSOI器件的制备与背偏效应研究 被引量:1
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作者 李亦琨 孙亚宾 +5 位作者 李小进 石艳玲 王玉恒 王昌锋 廖端泉 田明 《微电子学》 CAS 北大核心 2019年第3期431-435,共5页
提出了一种基于后栅极工艺的22 nm全耗尽绝缘体上硅(FDSOI)器件的制备方法。基于电学测试结果,分析了器件的基本性能,研究了背栅偏压对器件性能的影响。结果表明,器件的开关电流比比较高、亚阈值摆幅较小,符合产业的一般标准。背栅偏压... 提出了一种基于后栅极工艺的22 nm全耗尽绝缘体上硅(FDSOI)器件的制备方法。基于电学测试结果,分析了器件的基本性能,研究了背栅偏压对器件性能的影响。结果表明,器件的开关电流比比较高、亚阈值摆幅较小,符合产业的一般标准。背栅偏压对长沟道和短沟道器件的阈值电压均有明显的影响。电路设计人员可以根据不同需求,选择工作在正向体偏置(FBB)模式或者反向体偏置(RBB)模式的器件。 展开更多
关键词 全耗尽绝缘体上硅 后栅极工艺 背栅偏压 阈值电压
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一种新型的自对准源漏接触技术
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作者 张琴 洪培真 +3 位作者 崔虎山 卢一泓 贾宬 钟汇才 《微纳电子技术》 CAS 北大核心 2014年第5期328-332,共5页
提出了一种用于亚微米尺寸以下MOSFET器件的自对准源漏接触技术。这种新型的集成方法改变了传统的工艺步骤,即光刻接触孔,然后向里填充导电材料。在形成栅极、绝缘介质侧墙以及自对准金属硅化物以后,通过沉积金属膜层,并各向异性刻蚀以... 提出了一种用于亚微米尺寸以下MOSFET器件的自对准源漏接触技术。这种新型的集成方法改变了传统的工艺步骤,即光刻接触孔,然后向里填充导电材料。在形成栅极、绝缘介质侧墙以及自对准金属硅化物以后,通过沉积金属膜层,并各向异性刻蚀以在绝缘介质侧墙两旁形成一对金属的侧墙结构。这个侧墙连接底部的源漏区和上部的互联区,作为底层的金属接触引出。这个方法不仅减小了刻蚀接触孔的难度,且采用自对准的方法形成金属接触也减小了源漏接触的距离,提高了集成度。这项工艺集成技术尝试应用于0.5μm栅长MOSFET器件结构中,并仿真得到了良好的电学性能。 展开更多
关键词 自对准源漏接触 金属侧墙 集成度 亚微米 前栅工艺 后栅工艺
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用于后栅工艺的SOI-FinFET选择性沟道缩小技术
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作者 李俊锋 马小龙 +1 位作者 王防防 许淼 《微纳电子技术》 CAS 北大核心 2015年第7期460-473,共14页
在FinFET技术中Fin的宽度对器件性能有重要影响。较窄的Fin能够更好地抑制短沟道效应,改善器件亚阈值特性,但同时也导致源漏扩展区寄生电阻增大,驱动电流减小。提出了一种用于FinFET后栅工艺的选择性沟道缩小技术,即在去除多晶硅假栅后... 在FinFET技术中Fin的宽度对器件性能有重要影响。较窄的Fin能够更好地抑制短沟道效应,改善器件亚阈值特性,但同时也导致源漏扩展区寄生电阻增大,驱动电流减小。提出了一种用于FinFET后栅工艺的选择性沟道缩小技术,即在去除多晶硅假栅后,对沟道区露出的Fin进行氢气(含氯基)热退火处理,在减小沟道区Fin的宽度、使沟道区Fin表面光滑的同时,保持源漏扩展区Fin的宽度不变。这种自对准的沟道缩小方法简单有效地解决了亚阈值特性和源漏扩展区寄生电阻对Fin宽要求不一致的问题,并改善了器件的拐角效应。这项工艺集成技术应用于栅长为25 nm^0.5μm的SOI-FinFET器件结构中,并测试得到了良好的器件电学特性。 展开更多
关键词 FinFET器件 SOI衬底 后栅工艺 选择性沟道缩小 亚阈值特性
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金属栅功函数优化及其后栅工艺对32nm器件性能的模拟研究
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作者 赵猛 施雪捷 +2 位作者 杨勇胜 潘梓诚 俞少峰 《科学技术与工程》 北大核心 2013年第30期8921-8927,共7页
基于Synopsys SWB仿真平台,研究了高K介质金属栅器件中栅功函数变化在N/PMOSFET器件的影响;模拟和分析了金属栅功函数在L gate=32 nm N/PMOSFET器件工作特性提高中的最佳优化方向及其机理。研究结果表明,栅极功函数对N/PMOS器件工作电流... 基于Synopsys SWB仿真平台,研究了高K介质金属栅器件中栅功函数变化在N/PMOSFET器件的影响;模拟和分析了金属栅功函数在L gate=32 nm N/PMOSFET器件工作特性提高中的最佳优化方向及其机理。研究结果表明,栅极功函数对N/PMOS器件工作电流I dsat的影响并非简单地单调变化,而是呈现类似钟型分布的特性;存在最佳工作点。同时金属功函数的优化对于器件短沟道效应SCE和关断漏电流的抑制有着显著地影响。此外通过模拟金属栅替代多晶硅栅的应力模拟表明,自去除多晶硅栅到在沉积金属栅的过程中,会对器件沟道区产生明显的应力作用,从而极大提高器件的工作电流特性。因而,采用优化的金属栅代替多晶硅栅结合High-k材料可以有力推动CMOS器件继续沿着摩尔定律向更小器件尺寸的发展。 展开更多
关键词 金属栅 功函数 短沟道效应 工作电流 后栅工艺 机械应力
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