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面向高帧率CMOS图像传感器的12位列级全差分SAR/SS ADC设计
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作者 牛志强 陈志坤 +4 位作者 胡子阳 王刚 刘剑 吴南健 冯鹏 《集成电路与嵌入式系统》 2024年第5期48-54,共7页
针对高帧率CMOS图像传感器的应用需求,提出一种结合逐次逼近型(Successive Approximation Register,SAR)和单斜坡(Single Slope,SS)结构的混合型模拟数字转换器(Analog to Digital Converter,ADC)。该ADC的分辨率为12位,其中SAR ADC实现... 针对高帧率CMOS图像传感器的应用需求,提出一种结合逐次逼近型(Successive Approximation Register,SAR)和单斜坡(Single Slope,SS)结构的混合型模拟数字转换器(Analog to Digital Converter,ADC)。该ADC的分辨率为12位,其中SAR ADC实现高6位量化,SS ADC实现低6位量化。该ADC采用了全差分结构消除采样开关的固定失调并减少非线性误差,同时在SAR ADC中采用了异步逻辑电路进一步缩短转换周期。采用110 nm 1P4M CMOS工艺对该电路进行了设计和版图实现,后仿真结果表明,在20 MHz的时钟下,转换周期仅为3.3μs,无杂散动态范围为77.12 dB,信噪失真比为67.38 dB,有效位数为10.90位。 展开更多
关键词 高帧率CMOS图像传感器 混合型列adc 单斜adc 逐次逼近型adc 电流舵DAC
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一种12 bit 200 MS/s低功耗SAR-TDC ADC
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作者 韦雪明 尹仁川 +2 位作者 徐卫林 李海鸥 李建华 《微电子学》 CAS 北大核心 2023年第5期764-771,共8页
为了满足低电压条件下高速高精度采样需求,设计了一种电压-时域两级混合结构流水线模数转换器(ADC)。该流水线ADC的第一级逐次逼近型(SAR)ADC将电压转换为8 bit数字,残差电压变换为时域延时信息后,第二级4.5 bit时间数字转换器(TDC)将... 为了满足低电压条件下高速高精度采样需求,设计了一种电压-时域两级混合结构流水线模数转换器(ADC)。该流水线ADC的第一级逐次逼近型(SAR)ADC将电压转换为8 bit数字,残差电压变换为时域延时信息后,第二级4.5 bit时间数字转换器(TDC)将延时转换,最终校准输出,实现12 bit精度转换。通过采用多电压供电、改进残差电压转移和放大器结构,以及优化时间判决器,提升了ADC的动态性能和采样速度,降低了采样功耗。该ADC基于40 nm CMOS工艺设计和仿真。采样率为200 MS/s时,功耗为9.5 mW,动态指标SNDR、SFDR分别达到68.4 dB、83.6 dB,优值为22 pJ·conv^(-1)·step^(-1),能够满足低功耗高速采样的应用需求。 展开更多
关键词 混合架构 高速adc 电压-时域转换 时间数字转换器
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一种可校正的12位C2C电容阵列混合结构SAR ADC
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作者 韩文涛 明平文 +3 位作者 肖航 张中 李靖 于奇 《微电子学》 CAS 北大核心 2023年第3期359-365,共7页
提出了一种可校正的12位C2C电容阵列混合结构逐次逼近型模数转换器(SAR ADC),其数模转换器(DAC)由低6位分裂式C2C DAC阵列与高6位二进制DAC阵列构成。提出的混合结构DAC既解决了中高精度二进制SAR ADC中总电容过大的问题,又避免了分段... 提出了一种可校正的12位C2C电容阵列混合结构逐次逼近型模数转换器(SAR ADC),其数模转换器(DAC)由低6位分裂式C2C DAC阵列与高6位二进制DAC阵列构成。提出的混合结构DAC既解决了中高精度二进制SAR ADC中总电容过大的问题,又避免了分段式二进制DAC分数值桥接电容无法与单位电容形成匹配的问题。该结构能显著降低整个ADC的动态功耗。此外,将高位终端电容和低2~6位量化电容拆分成相等的两个电容,引入冗余量,使得该ADC的电容权重可以被校准,降低了电容失配以及寄生电容的影响。最后,为了避免电容上极板复位信号因电容阵列容值大而导致的延时偏大问题,采用高6位DAC采样的方式,并在高6位DAC中引入单位电容大小的终端电容,弥补了参考电压区间不完整的缺陷。仿真结果显示,在1.5 V电压下,该ADC总体功耗仅为111.84μW,ENOB为12.49位,SFDR为91.46 dB,SNDR为76.97 dB。 展开更多
关键词 模数转换器 数模转换器 C2C电容阵列 混合结构SAR模数转换器 LMS校正算法
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Hybrid and Full-Digital Beamforming in mmWave Massive MIMO Systems: A Comparison Considering Low-Resolution ADCs 被引量:2
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作者 Wence Zhang Xiaoxuan Xia +1 位作者 Yinkai Fu Xu Bao 《China Communications》 SCIE CSCD 2019年第6期91-102,共12页
In a millimeter-wave(mmWave)Massive multiple-input multiple-output(MIMO)systems,full-digital beamforming(i.e.,connecting each antenna with a specific radio-frequency(RF)chain)becomes inefficient due to the hardware co... In a millimeter-wave(mmWave)Massive multiple-input multiple-output(MIMO)systems,full-digital beamforming(i.e.,connecting each antenna with a specific radio-frequency(RF)chain)becomes inefficient due to the hardware cost and power consumption.Therefore,hybrid analog and digital transceiver where the number of RF chains are much smaller than that of the antennas has drawn great research interest.In this work,we investigate the use of low-resolution analog-to-digital converters(ADCs)in the uplink of multi-user hybrid and full-digital mmWave Massive MIMO systems.To be specific,we compare the performance of full-digital minimum mean square error(MMSE)and hybrid MMSE beamforming in both sum rates and energy efficiency.Accurate approximations of sum rates and energy efficiency are provided for both schemes,which captures the dominant factors.The analytical results show that full-digital beamforming outperforms hybrid beamforming in terms of sum rates and requires only a small portion(γ)of antennas used by hybrid beamforming to achieve the same sum rates.We given sufficient condition for full-digital beamforming to outperform hybrid beamforming in terms of energy efficiency.Moreover,an algorithm is proposed to search for the optimal ADC resolution bits.Numerical results demonstrate the correctness of the analysis. 展开更多
关键词 hybrid MASSIVE MIMO mmWave MMSE low-resolution adcS
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基于混合型ADC的高精度温度传感器研制
5
作者 黄立朝 张淑慧 +1 位作者 章宇新 孔祥艺 《固体电子学研究与进展》 CAS 北大核心 2023年第3期253-258,共6页
介绍了一种基于0.18μm CMOS工艺的高精度数字式温度传感器电路。在感温前端模块,通过利用动态匹配技术与斩波技术,并采用混合型一阶sigma-delta/SAR型ADC,在降低功耗的同时实现更高的分辨率,提高温度传感器的采样精度。经过仿真及测试... 介绍了一种基于0.18μm CMOS工艺的高精度数字式温度传感器电路。在感温前端模块,通过利用动态匹配技术与斩波技术,并采用混合型一阶sigma-delta/SAR型ADC,在降低功耗的同时实现更高的分辨率,提高温度传感器的采样精度。经过仿真及测试验证,提出的基于混合型ADC的高精度数字式温度传感器电路,提供16 bit温度结果,应用时无需校准即可在-25~55℃的温度范围内达到±0.1℃精度。通过使能控制,极大程度地减少自发热对测温精度的影响,在1.7~5.5 V的电压范围内,电流最大值仅为5μA。在达到高精度的同时,降低了成本与功耗。 展开更多
关键词 温度传感器 混合型adc sigma-delta adc 动态元件匹配
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软件无线电的直接射频采样ADC系统研究 被引量:7
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作者 彭安金 李凤保 古天祥 《仪器仪表学报》 EI CAS CSCD 北大核心 2003年第4期331-334,339,共5页
提出了一种高速混合滤波器组 ADC系统 ,该 ADC系统能对射频模拟信号 (2 MHz~ 2 0 0 0 MHz)直接进行模 /数转换 ,而且分辨率达到 1 2比特以上。显然 ,用此高速混合滤波器组
关键词 高速混合滤波器组 adc系统 直接射频采样 软件无线电
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软件无线电直接射频采样的高速ADC系统研究 被引量:7
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作者 彭安金 陈向东 古天祥 《电波科学学报》 EI CSCD 2003年第2期184-188,193,共6页
针对混合滤波器组ADC系统因其ADC模拟输入带宽低而不能对频率较高的射频模拟信号直接进行模 /数转换的瓶颈 ,本文提出了一种基于Nyquist采样定理和带通采样定理的抽取器数学模型 ,对该数学模型进行时域、频域的分析证明后 ,设计了一种... 针对混合滤波器组ADC系统因其ADC模拟输入带宽低而不能对频率较高的射频模拟信号直接进行模 /数转换的瓶颈 ,本文提出了一种基于Nyquist采样定理和带通采样定理的抽取器数学模型 ,对该数学模型进行时域、频域的分析证明后 ,设计了一种基于该数学模型的SHA抽取器 ,进而在混合滤波器组ADC系统的基础上 ,提出了高速混合滤波器组ADC系统。它能将带宽为 (2MHz~ 2 0 0 0MHz)的射频模拟信号直接模 /数转换 ,且分辨率达到 12比特以上 。 展开更多
关键词 软件无线电 混合滤波器组 adc系统 模/数转换 射频采样
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混合滤波器组ADC系统的频响分析与量化噪声研究 被引量:5
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作者 彭安金 陈向东 古天祥 《系统工程与电子技术》 EI CSCD 北大核心 2003年第9期1068-1071,共4页
根据带通采样定理对混合滤波器组ADC系统的抽取过程进行了系统理论分析,得到其失真/混迭函数。利用混合滤波器组ADC系统之综合滤波器组的多相结构,对混合滤波器组ADC系统量化噪声进行了详细研究。所得的理论结果为混合滤波器组ADC系统... 根据带通采样定理对混合滤波器组ADC系统的抽取过程进行了系统理论分析,得到其失真/混迭函数。利用混合滤波器组ADC系统之综合滤波器组的多相结构,对混合滤波器组ADC系统量化噪声进行了详细研究。所得的理论结果为混合滤波器组ADC系统的失真/混迭函数与开关电容滤波器组ADC系统的失真/混迭函数一致,且混合滤波器组ADC系统的分辨率比其ADC提高了0.51og2M比特。 展开更多
关键词 失真/混迭函数 量化噪声 分辨率 混合滤波器组adc系统 开关电容滤波器组adc系统
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高速高精度ADC系统研究 被引量:6
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作者 李和平 王岩飞 《数据采集与处理》 CSCD 北大核心 2008年第B09期208-211,共4页
由于单个ADC模拟输入带宽的限制,混合滤波器组ADC系统不能够直接对高达数GHz的模拟信号进行采样。本文提出了基于混频器和低通滤波器的抽取器数学模型,并且从时域和频域进行详细的分析和证明。最后在混合滤波器组ADC系统的基础上,提出... 由于单个ADC模拟输入带宽的限制,混合滤波器组ADC系统不能够直接对高达数GHz的模拟信号进行采样。本文提出了基于混频器和低通滤波器的抽取器数学模型,并且从时域和频域进行详细的分析和证明。最后在混合滤波器组ADC系统的基础上,提出了基于混频器和低通滤波器的高速高精度混合滤波器组ADC系统,它完全满足软件无线电和雷达等多个领域的高速高精度要求。 展开更多
关键词 adc系统 混合滤波器组 抽取器
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软件无线电直接射频采样的低速高效ADC系统研究 被引量:1
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作者 彭安金 李智 古天祥 《电子测量与仪器学报》 CSCD 2003年第1期46-52,共7页
本文提出了一种低速高效混合滤波器组ADC系统,该ADC系统能对射频模拟信号(2MHz- 2000MHz)直接进行模/数转换,而且分辨率达到14比特以上,但其数字信号输出速率才105M SPS,因而该低速高 效混合滤波器组ADC系统对软件无线电的直接射频采样... 本文提出了一种低速高效混合滤波器组ADC系统,该ADC系统能对射频模拟信号(2MHz- 2000MHz)直接进行模/数转换,而且分辨率达到14比特以上,但其数字信号输出速率才105M SPS,因而该低速高 效混合滤波器组ADC系统对软件无线电的直接射频采样有很高的实用价值。 展开更多
关键词 单SHA抽取器 adc系统 低速高效混合滤波器组adc系统 软件无线电
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基于混合编码DAC的低功耗SAR ADC设计 被引量:2
11
作者 杨明 赵毅强 夏璠 《微电子学与计算机》 CSCD 北大核心 2013年第7期91-94,共4页
设计了一种基于混合编码DAC的低功耗SAR ADC.其分段电容DAC采用混合编码,减小了短时脉冲波形干扰的影响;为降低DAC寄生效应和电容阵列失配误差的影响,在DAC和比较器的版图设计中考虑了一些匹配技术.采用GF(Global Foundry)0.35μm CMOS... 设计了一种基于混合编码DAC的低功耗SAR ADC.其分段电容DAC采用混合编码,减小了短时脉冲波形干扰的影响;为降低DAC寄生效应和电容阵列失配误差的影响,在DAC和比较器的版图设计中考虑了一些匹配技术.采用GF(Global Foundry)0.35μm CMOS工艺流片验证,该ADC在500KSPS的速度下其INL在-0.6~0.4LSB区间范围内,DNL在-0.2~0.7LSB区间范围内,SNDR为54.13dB,有效位为8.7位.整个电路的功耗为537.9μW. 展开更多
关键词 逐次逼近模数转换器 混合编码 匹配技术 低功耗
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基于混合模型的异构无人机蜂群效能评估
12
作者 卢元杰 龙珊珊 +2 位作者 赵航 冯国旭 赵晓葭 《系统仿真学报》 CAS CSCD 北大核心 2024年第3期700-712,共13页
为实现无人机蜂群效能的快速评估,提出一种基于ADC(availability dependability capability)系统效能评估和BP神经网络预测的混合模型,以应对无人机蜂群配置和状态的多样性以及效能计算的复杂性。在分析蜂群效能构成要素的基础上,建立... 为实现无人机蜂群效能的快速评估,提出一种基于ADC(availability dependability capability)系统效能评估和BP神经网络预测的混合模型,以应对无人机蜂群配置和状态的多样性以及效能计算的复杂性。在分析蜂群效能构成要素的基础上,建立包含无人机通用平台能力,系统级能力,以及任务执行能力的能力指标体系。利用ADC法生成蜂群作战效能样本集合,运用BP神经网络构建关于无人机参数和能力指标的综合作战效能评估模型。利用该评估模型实现异构无人机蜂群实例的综合作战效能评估。结果表明:该模型评估误差可达5%以下,基于样本的评估时间可达3h以内,验证了该模型在异构无人机蜂群效能评估中的有效性及高效性。同时,通过分析数量、配置对无人机蜂群综合效能的影响,获得了异构无人机蜂群配置的可行建议。 展开更多
关键词 异构无人机 蜂群系统 效能评估 adc-BP神经网络 混合模型
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基于SAR-SS架构的图像传感器专用高速列级ADC设计 被引量:1
13
作者 刘宇帆 刘炯晗 +3 位作者 程禹 曲杨 钟国强 常玉春 《半导体光电》 CAS 北大核心 2022年第6期1119-1123,共5页
针对图像传感器中传统列级模数转换器(ADC)难以实现高帧频的问题,提出了一种由逐次逼近寄存器型(SAR)ADC和单斜坡型(SS)ADC组成的混合型高速列级ADC,使转换周期相较于传统的SS ADC缩短约97%;利用SAR ADC的电容实现像素的相关双采样(CDS)... 针对图像传感器中传统列级模数转换器(ADC)难以实现高帧频的问题,提出了一种由逐次逼近寄存器型(SAR)ADC和单斜坡型(SS)ADC组成的混合型高速列级ADC,使转换周期相较于传统的SS ADC缩短约97%;利用SAR ADC的电容实现像素的相关双采样(CDS),在模拟域做差,使CDS的量化时间缩短至一个转换周期,进一步提高了ADC的量化速度;为了保证列级ADC的线性度,提出了一种1 bit冗余算法,可实现+0.13/-0.12 LSB的微分非线性和+0.18/-0.93 LSB的积分非线性。基于180 nm CMOS工艺的仿真结果表明,该列级ADC在50 MHz时钟下,转换周期仅为1μs,无杂散动态范围为73.50 dB,信噪失真比为66.65 dB,有效位数为10.78 bit。 展开更多
关键词 图像传感器 高速列级adc 逐次逼近寄存器adc 单斜坡adc 混合型adc 相关双采样
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一种混合滤波器组ADC对时序误差的敏感度研究 被引量:3
14
作者 胡雅洁 《重庆理工大学学报(自然科学)》 CAS 2016年第3期99-103,共5页
在混合滤波器组ADC系统广泛用于通信领域的背景下,提出一种基于带通电荷取样滤波器的混合滤波器组模型。采用两种方法对模型进行建模,分析模型对采样时序误差的敏感度。通过两种方法得出的一致结果表明:该模型对时序误差敏感度低,验证... 在混合滤波器组ADC系统广泛用于通信领域的背景下,提出一种基于带通电荷取样滤波器的混合滤波器组模型。采用两种方法对模型进行建模,分析模型对采样时序误差的敏感度。通过两种方法得出的一致结果表明:该模型对时序误差敏感度低,验证了其可靠性。 展开更多
关键词 混合滤波器组adc系统 时序误差 带通电荷取样滤波器
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一种10位高速Pipeline-SAR混合型ADC设计
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作者 李霄 李潇然 +2 位作者 张浩 杨佳衡 张蕾 《微电子学》 CAS 北大核心 2022年第4期603-607,共5页
基于180 nm CMOS工艺,设计了一种无残差放大的10位100 MS/s流水线与逐次逼近混合型ADC。采用两级流水线-逐次逼近混合型结构,第一级完成4位粗量化转换,第二级完成6位细量化转换。为了降低整体电路功耗,采用单调式电容控制切换方式,两级... 基于180 nm CMOS工艺,设计了一种无残差放大的10位100 MS/s流水线与逐次逼近混合型ADC。采用两级流水线-逐次逼近混合型结构,第一级完成4位粗量化转换,第二级完成6位细量化转换。为了降低整体电路功耗,采用单调式电容控制切换方式,两级之间残差电压采用采样开关电荷共享方式实现。采用异步时序控制逻辑,进一步提升了能量利用率和转换速度。后仿真结果表明,在100 MS/s奈奎斯特采样率下,有效位数为9.39 bit,信噪失真比为58.34 dB,1.8 V电源电压下整体功耗为5.9 mW。 展开更多
关键词 流水线与逐次逼近混合型adc 电荷重分配 单调式开关切换
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一种基于FLASH的混合式11位ADC设计
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作者 田德永 黄维超 《电子器件》 CAS 北大核心 2015年第3期562-568,共7页
时域延迟线架构ADC的非线性问题,导致其无法达到较高的分辨率。针对该问题,提出了一种将Flash和延迟线架构相结合的新型低功耗11位ADC。该新型混合ADC架构由两个模块构成,分别为4位Flash ADC架构和7位延迟线ADC架构,因此同时具有Flash ... 时域延迟线架构ADC的非线性问题,导致其无法达到较高的分辨率。针对该问题,提出了一种将Flash和延迟线架构相结合的新型低功耗11位ADC。该新型混合ADC架构由两个模块构成,分别为4位Flash ADC架构和7位延迟线ADC架构,因此同时具有Flash ADC和延迟线ADC的准确性和高效性。采用CHARTERED 65 nm Dual Gate Mixed Signal CMOS Process设计并绘制出混合式ADC版图。实验测试结果显示,在供应电压为1.1 V和采样效率为100 Msample/s的条件下,混合式ADC产生的信噪失真比(SNDR)为60 d B,消耗功率为1.6 m W。在无需任何校准技术的情况下,混合式ADC产生的品质因数(FOM)为19.4 f J/分级转换。此外,利用不匹配的3σ设备进行了蒙特卡罗试验,结果表明,SNDR值低于其ADC架构。 展开更多
关键词 混合式adc 延迟线架构 FLASH 加减器
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12 bit 100 MS/s Flash-SAR混合模数转换器设计
17
作者 田芮谦 宋树祥 +3 位作者 赵媛 岑明灿 蔡超波 蒋品群 《无线电工程》 北大核心 2023年第6期1421-1429,共9页
针对传统逐次逼近型模数转换器(Successive Approximation Register Analog-to-Digital Converter,SAR ADC)采样率和能量效率低等问题,设计了一款快闪型(Flash)与逐次逼近型(SAR)相结合的新型混合架构模数转换器。利用快闪型ADC一个时... 针对传统逐次逼近型模数转换器(Successive Approximation Register Analog-to-Digital Converter,SAR ADC)采样率和能量效率低等问题,设计了一款快闪型(Flash)与逐次逼近型(SAR)相结合的新型混合架构模数转换器。利用快闪型ADC一个时钟周期内可以转换出多个数字码的优势,提高了ADC的采样率。采用新型混合开关切换策略与分段电容阵列技术相结合提升了ADC的能量效率,减小了版图面积。同时,电路采用预放大动态锁存比较器以降低噪声和失调对ADC性能的影响。采用SMIC 0.11μm工艺后,仿真结果表明,在1.2 V的工作电压下,当采样速率为100 MS/s,输入信号频率为45.04 MHz时,输出信号的信号噪声失真比(Signal-to-Noise-and-Distortion Radio,SNDR)为69.26 dB,无杂散动态范围(Spurious-free Dynamic Range,SFDR)为82.10 dB,有效位数(Effective Numbers of Bits,ENOB)达到11.21 bit,功耗为5.72 mW,版图尺寸为380μm×110μm。 展开更多
关键词 逐次逼近 快闪型模数转换器 新型混合开关切换策略 预放大动态锁存比较器 异步时序
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一种超宽带光电混合结构A/D转换器 被引量:1
18
作者 蒋飞宇 朱璨 +2 位作者 俞宙 付东兵 夏茜 《微电子学》 CAS 北大核心 2021年第4期466-470,共5页
现代宽带数字接收机对高性能模数转换器(ADC)的需求逐渐增大,而电子学ADC因载流子迁移速率限制无法实现超宽带直接数字采样。基于光子技术超宽带、超高速的特性,文章提出了一种光电混合结构的ADC技术。通过采用基于超短光脉冲的光学采... 现代宽带数字接收机对高性能模数转换器(ADC)的需求逐渐增大,而电子学ADC因载流子迁移速率限制无法实现超宽带直接数字采样。基于光子技术超宽带、超高速的特性,文章提出了一种光电混合结构的ADC技术。通过采用基于超短光脉冲的光学采样代替基于电子学半导体技术的采样/保持(S/H)电路来大幅提高采样带宽。采用时分复用及多通道电学ADC量化技术实现信号数字编码。最后通过数字域均衡与线性化处理提高系统性能,实现了对频率大于24 GHz的微波信号的直接采样,采样信噪比大于40 dB,为超宽带微波信号高精度直接数字化提供了有效途径。 展开更多
关键词 光电混合结构adc 光学采样 低时钟抖动 电学量化
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低DNL的SAR型模数转换器的设计
19
作者 裴晓敏 《固体电子学研究与进展》 CAS CSCD 北大核心 2010年第3期458-462,共5页
保证DAC中元器件的精度、减小DNL误差是提高SAR ADC性能的关键。通过对SAR ADC内部DAC的结构进行综合分析,针对传统的C-R混合式结构中的集总电容阵列进行了优化设计。电容阵列由相同的非集总的单位电容组成,并通过数字逻辑的控制来实现... 保证DAC中元器件的精度、减小DNL误差是提高SAR ADC性能的关键。通过对SAR ADC内部DAC的结构进行综合分析,针对传统的C-R混合式结构中的集总电容阵列进行了优化设计。电容阵列由相同的非集总的单位电容组成,并通过数字逻辑的控制来实现对单位电容连接点的选择。验证结果证明设计有效,ENOB、SFDR和SINAD等参数都得到明显的提高,保证了SARADC的单调性,实现了低DNL的SAR型模数转换器的设计。 展开更多
关键词 模数转换器 微分非线性 积分非线性 电容电阻混合 单调性
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基于混合滤波器组的时间交替采样技术 被引量:2
20
作者 刘进军 陈颖 《电讯技术》 2007年第6期155-157,共3页
时间交替采样技术对通道失配误差十分敏感,而基于混合滤波器组的采样技术降低了对通道失配误差的敏感,但前端模拟分析滤波器的稳定性难于设计限制了其工程应用。结合时间交替和混合滤波器组采样技术,提出了一种易于工程实现的基于混合... 时间交替采样技术对通道失配误差十分敏感,而基于混合滤波器组的采样技术降低了对通道失配误差的敏感,但前端模拟分析滤波器的稳定性难于设计限制了其工程应用。结合时间交替和混合滤波器组采样技术,提出了一种易于工程实现的基于混合滤波器组的时间交替采样技术。仿真结果表明,该技术能显著提高采样系统的精度。 展开更多
关键词 模数转换器 混合滤波器组 时间交替采样 通道失配误差
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