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高性能微处理器中采用多种预取技术的指令Cache设计 被引量：2
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作者 周宏伟 张民选 《计算机工程与科学》 CSCD 2004年第11期103-105,共3页
本文分析了传统的指令预取技术,并结合显性指令并行计算(EPIC)体系结构,研究了基于编译器与处理器通信的新的指令预取技术,提出了一种支持多种预取技术的L1指令Cache设计方案。
关键词 指令预取 高性能微处理器 编译器 并行计算 EPIC 体系结构 通信 技术 支持 显性
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