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A High-Speed Dual Modulus Prescaler Using 0.25 μm CMOS Technology
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作者 杨文荣 曹家麟 +1 位作者 冉峰 王健 《Journal of Shanghai University(English Edition)》 CAS 2004年第3期342-347,共6页
A high-speed dual-modulus divide-by-32/33 prescaler has been developed using 0.25 μm CMOS technology. The source-coupled logic (SCL) structure is used to reduce the switching noise and to ameliorate the power-speed t... A high-speed dual-modulus divide-by-32/33 prescaler has been developed using 0.25 μm CMOS technology. The source-coupled logic (SCL) structure is used to reduce the switching noise and to ameliorate the power-speed tradeoff. The proposed prescaler can operate at high frequency with a low-power consumption. Based on the 2.5 V, 0.25 μm CMOS model, simulation results indicate that the maximum input frequency of the prescaler is up to 3.2 GHz. Running at 2.5 V, the circuit consumes only 4.6 mA at an input frequency 2.5 GHz. 展开更多
关键词 CMOS prescaler source-coupled logic(SCL) phase-locked loop(PLL).
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Exact Analytical and Numerical Solutions to the Time-Dependent Schrödinger Equation for a One-Dimensional Potential Exhibiting Non-Exponential Decay at All Times
2
作者 Athanasios N. Petridis Lawrence P. Staunton +1 位作者 Jon Vermedahl Marshall Luban 《Journal of Modern Physics》 2010年第2期124-136,共13页
The departure at large times from exponential decay in the case of resonance wavefunctions is mathematically demonstrated. Then, exact, analytical solutions to the time-dependent Schr?dinger equation in one dimension ... The departure at large times from exponential decay in the case of resonance wavefunctions is mathematically demonstrated. Then, exact, analytical solutions to the time-dependent Schr?dinger equation in one dimension are developed for a time-independent potential consisting of an infinite wall and a repulsive delta function. The exact solutions are obtained by means of a superposition of time-independent solutions spanning the given Hilbert space with appropriately chosen spectral functions for which the resulting integrals can be evaluated exactly. Square-integrability and the boundary conditions are satisfied. The simplest of the obtained solutions is presented and the probability for the particle to be found inside the potential well as a function of time is calculated. The system exhibits non-exponential decay for all times;the probability decreases at large times as . Other exact solutions found exhibit power law behavior at large times. The results are generalized to all normalizable solutions to this problem. Additionally, numerical solutions are obtained using the staggered leap-frog algorithm for select potentials exhibiting the prevalence of non-exponential decay at short times. 展开更多
关键词 non-exponential Decay EXACT Solutions
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Equilibrium dividend strategies in the dual model with a random time horizon
3
作者 ZHAO Yong-xia YE Chuan-xiu CHENG Gong-pin 《Applied Mathematics(A Journal of Chinese Universities)》 SCIE CSCD 2023年第4期510-522,共13页
This paper investigates the dividend problem with non-exponential discounting in a dual model.We assume that the dividends can only be paid at a bounded rate and that the surplus process is killed by an exponential ra... This paper investigates the dividend problem with non-exponential discounting in a dual model.We assume that the dividends can only be paid at a bounded rate and that the surplus process is killed by an exponential random variable.Since the non-exponential discount function leads to a time inconsistent control problem,we study the equilibrium HJB-equation and give the associated verification theorem.For the case of a mixture of exponential discount functions and exponential gains,we obtain the explicit equilibrium dividend strategy and the corresponding equilibrium value function.Besides,numerical examples are shown to illustrate our results. 展开更多
关键词 equilibrium dividend strategies non-exponential discounting time inconsistence dual model equilibrium HJB-equation
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整体柔性聚能装药结构在煤系地层隧道切顶预裂爆破中的应用
4
作者 曹继翔 周向东 +3 位作者 冯向涛 张凌寒 王林林 曹晗 《价值工程》 2023年第33期55-57,共3页
沿空留巷由于能够节约大量的煤炭资源得到了广泛的应用,但对于放顶煤开采所形成的高采空区使得矿压显现剧烈,导致留巷困难,因此采用预裂爆破切顶卸压成为最有效的手段,但上向深孔装药困难经常导致爆破效果变差。本文提供了一种用于煤系... 沿空留巷由于能够节约大量的煤炭资源得到了广泛的应用,但对于放顶煤开采所形成的高采空区使得矿压显现剧烈,导致留巷困难,因此采用预裂爆破切顶卸压成为最有效的手段,但上向深孔装药困难经常导致爆破效果变差。本文提供了一种用于煤系地层隧道有限空间深孔预裂爆破柔性装药装置,该装置利用具有一定柔性的两个半圆硬质PVC管,将药包以及导爆索一次性布置于管内后使用胶带绑扎或PVC胶粘结为一个整体。由于整个装药结构具有一定柔性可弯折,在井下可沿巷道弯曲放置,逐步以垂直孔口的方向装入孔底,通过定位块控制药包切缝方向与相邻炮孔中心线连线方向一致,因此切缝能够起到聚能的效果,确保深孔预裂切缝爆破工程的有效实施。该装置在某高速公路煤系地层隧道的预裂爆破切顶中得到了广泛的应用,有效提高了装药效率,更好地保证装药质量,同时实现了聚能效应,扩大了切顶孔的间距。爆后的炮孔窥视结果证明了该装置的有效性。 展开更多
关键词 煤矿 深孔 预裂爆破 柔性装药装置 围岩运移规律
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一种适用于RF频率合成器的CMOS高速双模前置分频器 被引量:5
5
作者 杨文荣 曹家麟 +2 位作者 冉峰 王键 秦霆镐 《上海大学学报(自然科学版)》 CAS CSCD 北大核心 2005年第1期20-23,共4页
该文采用改进的CMOS源耦合逻辑(SCL)结构,设计了32 33分频的高速、低功耗双模前置分频器.设计基于中芯国际0.25μm1P5MCMOS工艺,利用CadenceSpectre工具仿真.仿真结果表明,该双模前置分频器最高工作频率可达3.2GHz,在2.5GHz输入下,工作... 该文采用改进的CMOS源耦合逻辑(SCL)结构,设计了32 33分频的高速、低功耗双模前置分频器.设计基于中芯国际0.25μm1P5MCMOS工艺,利用CadenceSpectre工具仿真.仿真结果表明,该双模前置分频器最高工作频率可达3.2GHz,在2.5GHz输入下,工作电压为2.5V时,功耗只有4.7mA. 展开更多
关键词 源耦合逻辑 CMOS 前置分频器
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可配置非幂方分频器的全新设计方法 被引量:7
6
作者 张多利 李丽 +1 位作者 高明伦 程作仁 《电子学报》 EI CAS CSCD 北大核心 2002年第8期1250-1252,共3页
本文采用基于计数空间完全划分和周期插入控制计数过程方法设计了非幂方分频器 ,采用这种全新思路设计的非幂方分频器分频范围很宽 ,分频输出对后续分频支持好 ,非常适用于通讯接口中的波特率时钟设计 .此外 ,这种设计思路对系统定时电... 本文采用基于计数空间完全划分和周期插入控制计数过程方法设计了非幂方分频器 ,采用这种全新思路设计的非幂方分频器分频范围很宽 ,分频输出对后续分频支持好 ,非常适用于通讯接口中的波特率时钟设计 .此外 ,这种设计思路对系统定时电路和节拍控制电路设计也有一定的借鉴意义 . 展开更多
关键词 可配置 非幂方分频器 Verlog-HDL 周期插入控制 分频范围
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一种新型高速低抖动低功耗双模预分频器及其在PLL频率综合器中的应用 被引量:7
7
作者 徐勇 王志功 +1 位作者 李智群 熊明珍 《Journal of Semiconductors》 EI CAS CSCD 北大核心 2005年第1期176-179,共4页
提出了一种零中频两次变频 80 2 11a接收机频率合成方案 ,降低电路功耗的同时 ,提高了电路可靠性 .改进了双模预分频器的结构 ,提出了一种新型集成“或”逻辑的SCL结构D锁存器 .采用 0 18μm数模混合CMOS工艺投片测试表明 ,双模预分... 提出了一种零中频两次变频 80 2 11a接收机频率合成方案 ,降低电路功耗的同时 ,提高了电路可靠性 .改进了双模预分频器的结构 ,提出了一种新型集成“或”逻辑的SCL结构D锁存器 .采用 0 18μm数模混合CMOS工艺投片测试表明 ,双模预分频器在 1 8V电源下功耗仅 5 76mW(1 8V× 3 2mA) ,RMS抖动小于 1% . 展开更多
关键词 双模预分频器 可编程分频器 低功耗 低抖动
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一种基于新的优化结构和动态电路技术CMOS双模预分频器(英文) 被引量:8
8
作者 池保勇 石秉学 《Journal of Semiconductors》 EI CAS CSCD 北大核心 2002年第4期357-361,共5页
提出了一种应用新的电路结构和动态电路技术的双模预分频器 ,它已用 0 .2 5μm CMOS数字工艺实现 .新的优化结构减少了电路的传输延迟 ,提高了电路速度 .基于这种优化结构和动态电路技术 ,提出了改进的 D型触发器 .为了验证其功能 ,制... 提出了一种应用新的电路结构和动态电路技术的双模预分频器 ,它已用 0 .2 5μm CMOS数字工艺实现 .新的优化结构减少了电路的传输延迟 ,提高了电路速度 .基于这种优化结构和动态电路技术 ,提出了改进的 D型触发器 .为了验证其功能 ,制作了一个试验型芯片 .经测试 ,该分频器在可以工作于 GHz频率范围 ;在电源电压为 2 .5 V ,输入频率为 2 .5 GHz时 ,其功耗仅为 35 m W(包括三个功耗很大的输出缓冲器的功耗 ) .由于其具有良好的性能 ,该分频器可应用于许多射频系统中 . 展开更多
关键词 双模预分频器 优化结构 CMOS集成电路 动态电路技术
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基于STM32的多步进电机控制系统研究 被引量:39
9
作者 刘慧英 范宝山 《测控技术》 CSCD 北大核心 2010年第6期54-57,共4页
在很多应用场合中,要求多台步进电机在运行目标距离不同的情况下,能同时启动、加速、高速、减速、制动停止。首先搭建了系统的主要硬件模块,在分析STM32产生PWM脉冲控制步进电机原理的前提下,提出了一种通过程序按照设定要求不断自动改... 在很多应用场合中,要求多台步进电机在运行目标距离不同的情况下,能同时启动、加速、高速、减速、制动停止。首先搭建了系统的主要硬件模块,在分析STM32产生PWM脉冲控制步进电机原理的前提下,提出了一种通过程序按照设定要求不断自动改变STM32中TIM预分频值的方法,实现多步进电机同步协调工作。然后对整个系统建立数学模型,通过理论分析和仿真验证,证明该系统能够满足所要求的性能指标。最后把该系统应用到实际环境中,通过对测量数据的分析,进一步验证了系统具有良好的稳态性能和动态性能。 展开更多
关键词 多步进电机 STM32 预分频值 同步协调 控制系统模型
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用于射频接收机的三阶多级Σ-Δ调制小数分频频率合成器的实现 被引量:5
10
作者 王皓磊 仲顺安 李国峰 《北京理工大学学报》 EI CAS CSCD 北大核心 2013年第3期307-310,317,共5页
基于TSMC 0.18μm工艺实现了一款适用于射频收发机的全集成小数分频频率合成器.设计中采用了三阶MASH结构Σ-Δ调制器以消除小数杂散,为节省芯片面积使用了环形振荡器,同时在电路设计中充分考虑了各种非理想因素以提高频谱纯净度和降低... 基于TSMC 0.18μm工艺实现了一款适用于射频收发机的全集成小数分频频率合成器.设计中采用了三阶MASH结构Σ-Δ调制器以消除小数杂散,为节省芯片面积使用了环形振荡器,同时在电路设计中充分考虑了各种非理想因素以提高频谱纯净度和降低芯片功耗.仿真结果表明,该频率合成器可以在900MHz~1.4GHz的频率范围内产生间隔为25kHz的输出信号.在1.2GHz输出时,偏离载波频率1MHz处的相位噪声可以达到-106dBc/Hz,锁定时间小于10μs. 展开更多
关键词 小数分频 多级整形Σ-Δ调制器 环形振荡器 双模预分频器
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单片UHF RFID阅读器中VCO及其预分频器设计 被引量:2
11
作者 陈子晏 谢传文 +4 位作者 陈磊 马和良 张润曦 赖宗声 景为平 《微电子学》 CAS CSCD 北大核心 2008年第5期708-712,共5页
提出了一种应用于860~960MHz UHF波段单片射频识别(RFID)阅读器的低相位噪声CMOS压控振荡器(VCO)及其预分频电路。VCO采用LC互补交叉耦合结构,利用对称滤波技术改善相位噪声性能,预分频电路采用注入锁定技术,用环形振荡结构获得了较宽... 提出了一种应用于860~960MHz UHF波段单片射频识别(RFID)阅读器的低相位噪声CMOS压控振荡器(VCO)及其预分频电路。VCO采用LC互补交叉耦合结构,利用对称滤波技术改善相位噪声性能,预分频电路采用注入锁定技术,用环形振荡结构获得了较宽的频率锁定范围。电路采用UMC0.18μm CMOS工艺实现,测试结果表明:VCO输出信号频率范围为1.283~2.557GHz,预分频电路的频率锁定范围为66.35%,输出四相正交信号。芯片面积约为1mm×1mm,当PLL输出信号频率为895.5MHz时,测得其相位噪声为-132.25dBc/Hz@3MHz,电源电压3.3V时,电路消耗总电流为8mA。 展开更多
关键词 低相位噪声 阅读器 射频识别 压控振荡器 预分频电路
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一种超低功耗5GHz双模预置分频器 被引量:3
12
作者 王永禄 杨毓军 周述涛 《微电子学》 CAS CSCD 北大核心 2006年第5期655-658,共4页
介绍了一种改进型的超高速、低功耗双模预置分频器(÷64/65、÷128/129)。该预置分频器采用0.35μmBiCMOS工艺制作,在3.5V电源电压下最高工作频率达5GHz,电源电流为4mA,电源电压3.3V时最高工作频率达4.8GHz。预置分... 介绍了一种改进型的超高速、低功耗双模预置分频器(÷64/65、÷128/129)。该预置分频器采用0.35μmBiCMOS工艺制作,在3.5V电源电压下最高工作频率达5GHz,电源电流为4mA,电源电压3.3V时最高工作频率达4.8GHz。预置分频器工作在0.5~5GHz频率范围内输入灵敏度小于一20dBm,工作在-55~125℃温度范围,最高频率达4.5GHz。 展开更多
关键词 触发器 低功耗电路 预置分频器 ECL电路
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一种InGaP/GaAs HBT高速预分频器MMIC 被引量:2
13
作者 李志强 张海英 +3 位作者 陈立强 张健 朱旻 尹军舰 《电子器件》 CAS 2007年第5期1555-1558,共4页
采用Foundry提供的InGaP/GaAs HBT工艺设计了一种数字静态除2高速预分频器MMIC.流片测试结果与仿真结果基本吻合,最高工作频率高于仿真结果.设计过程在速度和功耗之间进行了折中,并且考虑了自谐振频率对电路的影响.测试结果显示:在5V电... 采用Foundry提供的InGaP/GaAs HBT工艺设计了一种数字静态除2高速预分频器MMIC.流片测试结果与仿真结果基本吻合,最高工作频率高于仿真结果.设计过程在速度和功耗之间进行了折中,并且考虑了自谐振频率对电路的影响.测试结果显示:在5V电源电压下,该预分频器静态电流为60mA,最高工作频率达到15GHz,自谐振频率为19.79GHz.该MMIC可以直接应用到S-X波段射频微波系统中. 展开更多
关键词 MMIC GAAS HBT 预分频器 D触发器
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一种采用交错耦合VCO和高速前置分频器的频率合成器 被引量:4
14
作者 陈钰 洪志良 傅志军 《微电子学》 CAS CSCD 北大核心 2001年第3期212-215,共4页
文章提出了一种采用延迟单元交错耦合压控振荡器 (VCO)和高速双系数前置分频器的锁相环 (PLL)频率合成器设计方法。采用 0 .2 5μm的 CMOS工艺模型 ,在 Cadence环境下模拟 ,在相同级数情况下 ,设计获得的 VCO比传统顺序连接的 VCO速度快... 文章提出了一种采用延迟单元交错耦合压控振荡器 (VCO)和高速双系数前置分频器的锁相环 (PLL)频率合成器设计方法。采用 0 .2 5μm的 CMOS工艺模型 ,在 Cadence环境下模拟 ,在相同级数情况下 ,设计获得的 VCO比传统顺序连接的 VCO速度快 1 .4倍 ;运用动态 D触发器实现的双系数前置分频器 ,最高速度可达 2 GHz。该锁相环频率合成器在 40 0 MHz~ 1 .1 GHz的宽频范围内都能保持良好的相位跟踪特性 ,温度系数为 886ppm/°C,电源反射比为 3.3% 展开更多
关键词 频率合成器 压控振荡器 前置分频器 交错耦合
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STM32的无刷直流电机控制系统设计 被引量:16
15
作者 袁先圣 刘星 叶波 《单片机与嵌入式系统应用》 2013年第10期17-20,共4页
针对无刷直流电机的控制特点,分别从功率驱动和控制策略两方面进行分析和设计。选用STM32F103芯片作为主控制器,包含驱动电路、逆变电路、电流检测以及速度反馈电路,采用电流环、速度环双闭环控制策略,并且通过动态调节定时器预分频值... 针对无刷直流电机的控制特点,分别从功率驱动和控制策略两方面进行分析和设计。选用STM32F103芯片作为主控制器,包含驱动电路、逆变电路、电流检测以及速度反馈电路,采用电流环、速度环双闭环控制策略,并且通过动态调节定时器预分频值的方法提高速度采集的精度。实验结果表明,系统响应速度快,稳定性好,具有较高的工程应用价值。 展开更多
关键词 无刷直流电机 STM32 双闭环 预分频值
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一种可编程的2·4GHz CMOS多模分频器(英文) 被引量:1
16
作者 李志强 陈立强 +1 位作者 张健 张海英 《Journal of Semiconductors》 EI CAS CSCD 北大核心 2008年第2期224-228,共5页
采用0.35μm CMOS工艺设计并实现了一种多模分频器.该多模分频器由一个除4或5的预分频器和一个除128 ~255多模分频器在同一芯片上连接而成;在电路设计中,分析了预分频器功耗和速度之间的折中关系,根据每级单元电路的输入频率不同对128 ... 采用0.35μm CMOS工艺设计并实现了一种多模分频器.该多模分频器由一个除4或5的预分频器和一个除128 ~255多模分频器在同一芯片上连接而成;在电路设计中,分析了预分频器功耗和速度之间的折中关系,根据每级单元电路的输入频率不同对128 ~255多模分频器采用了功耗优化技术;对整个芯片的输入输出PAD进行了ESD保护设计;该分频器在单端信号输入情况下可以工作到2.4GHz ,在差分信号输入下可以工作到2.6GHz以上;在3 .3 V电源电压下,双模预分频器的工作电流为11 mA,多模分频器的工作电流为17 mA;不包括PAD的芯片核心区域面积为0.65 mm×0.3 mm.该可编程多模分频器可以用于2.4GHz ISM频段锁相环式频率综合器. 展开更多
关键词 预分频器 分频器 可编程 多模 频率综合器
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一种低功耗相位切换型分频器 被引量:2
17
作者 吉新村 夏晓娟 +1 位作者 徐严 胡伟 《南京邮电大学学报(自然科学版)》 北大核心 2017年第1期90-96,共7页
提出了一种低功耗的可编程分频器,包括相位切换型预分频器和可编程计数器,将相位切换预分频器中的相位选择器和二分频器组成套叠结构,降低了互连损耗和失配,省去了缓冲器以及二分频器的功耗,实现了一种低功耗的相位切换预分频器。将程... 提出了一种低功耗的可编程分频器,包括相位切换型预分频器和可编程计数器,将相位切换预分频器中的相位选择器和二分频器组成套叠结构,降低了互连损耗和失配,省去了缓冲器以及二分频器的功耗,实现了一种低功耗的相位切换预分频器。将程序计数器和脉冲吞咽计数器中D触发器进行共用,使计数器中D触发器的总数减少了一半,降低了可编程计数器的面积和功耗。采用SMIC 0.18μm CMOS工艺实现了相位选择器与二分频电路,并将之集成于4.8 GHz频段锁相环频率综合器中,工作频率为4.64~5.40 GHz,在1.8 V电源电压下,分频器消耗电流3 m A,其中相位选择器仅消耗550μA。 展开更多
关键词 相位切换型预分频器 可编程分频器 锁相环频率综合器
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应用于5GHz WLAN的单片CMOS频率综合器 被引量:1
18
作者 吴秀山 王志功 +4 位作者 康建颖 马成光 金琳 刘静 李青 《固体电子学研究与进展》 CAS CSCD 北大核心 2009年第2期231-236,共6页
采用中芯国际(SMIC)的0.18μm混合信号与射频1P6MCMOS工艺实现了WLAN802.11a收发机的锁相环型频率综合器,它集成了压控振荡器、双模预分频器、鉴频鉴相器、电荷泵、各种数字计数器、数字寄存器和控制等电路。基于环路的线性模型,对环路... 采用中芯国际(SMIC)的0.18μm混合信号与射频1P6MCMOS工艺实现了WLAN802.11a收发机的锁相环型频率综合器,它集成了压控振荡器、双模预分频器、鉴频鉴相器、电荷泵、各种数字计数器、数字寄存器和控制等电路。基于环路的线性模型,对环路参数的优化设计及环路性能进行了深入的讨论。流片后测试结果表明,该频率综合器的锁定范围为4096~4288MHz,在振荡频率为4.154GHz时,偏离中心频率1MHz处的相位噪声可以达到-117dBc/Hz,输出功率约为-3dBm。芯片面积为0.675mm×0.700mm。采用1.8V的电源供电,核心电路功耗约为24mW。 展开更多
关键词 频率综合器 锁相环 压控振荡器 预分频器 鉴频鉴相器 电荷泵 相位噪声
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应用于无线通信领域4.1 GHz锁相环的设计 被引量:1
19
作者 赵坤 满家汉 +1 位作者 叶青 叶甜春 《电子器件》 EI CAS 2006年第4期1042-1045,共4页
在分析锁相环线性模型的基础上,分析了影响锁相环系统的各种因素,采用相应的优化方法设计了一款4.1 GHzLC锁相环。详细介绍了该锁相环中各模块电路(包括LC型压控振荡器,高速分频器,数字分频器,鉴频/鉴相器,电荷泵以及无源滤波器等)的设... 在分析锁相环线性模型的基础上,分析了影响锁相环系统的各种因素,采用相应的优化方法设计了一款4.1 GHzLC锁相环。详细介绍了该锁相环中各模块电路(包括LC型压控振荡器,高速分频器,数字分频器,鉴频/鉴相器,电荷泵以及无源滤波器等)的设计,并且给出了仿真结果。其中高速分频器采用TSPC逻辑电路,速度快功耗低。该锁相环采用SMIC 0.18μm CMOS工艺设计,当VCO工作在4.1 GHz时,在频偏为600 kHz的相位噪声为-110 dBc。 展开更多
关键词 锁相环 压控振荡器 预分频器 TSPC动态电路
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数模混合GHz级频率综合器下变频模块设计(英文) 被引量:1
20
作者 徐勇 王志功 +3 位作者 仇应华 李智群 胡庆生 闵锐 《Journal of Semiconductors》 EI CAS CSCD 北大核心 2005年第9期1711-1715,共5页
介绍了一种应用于GHz级高速频率合成器的数模混合下变频模块.采用了高速射频双模预分频器与数字逻辑综合生成的可编程吞脉冲分频器相结合的设计方法.双模预分频实现了高速低抖动低功耗,双模预分频器工作在除8状态输出133MHz频率时,均方... 介绍了一种应用于GHz级高速频率合成器的数模混合下变频模块.采用了高速射频双模预分频器与数字逻辑综合生成的可编程吞脉冲分频器相结合的设计方法.双模预分频实现了高速低抖动低功耗,双模预分频器工作在除8状态输出133MHz频率时,均方差抖动小于2ps;可编程吞脉冲分频器算法灵活、设计复用性强,该算法可以灵活运用到许多复杂频率综合系统.相比较而言,该设计获得了更好的高频电路性能与设计复用性. 展开更多
关键词 锁相环 频率综合器 双模预分频器 可编程脉冲吞吐分频器
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