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基于可控制性度量的图神经网络门级硬件木马检测方法
1
作者
张洋
刘畅
李少青
《计算机工程》
CAS
CSCD
北大核心
2024年第7期164-173,共10页
随着全球化的不断深入,第三方知识产权(IP)核应用越来越广泛。随着硬件木马攻击技术逐渐成熟,使得在芯片设计阶段植入硬件木马成为可能。因此,在芯片设计过程中面临IP核被植入木马的严重威胁,现有研究所提的硬件木马检测方法具有依赖黄...
随着全球化的不断深入,第三方知识产权(IP)核应用越来越广泛。随着硬件木马攻击技术逐渐成熟,使得在芯片设计阶段植入硬件木马成为可能。因此,在芯片设计过程中面临IP核被植入木马的严重威胁,现有研究所提的硬件木马检测方法具有依赖黄金参考电路、需要完备的测试向量、大量的样本进行学习等特征。面向IP核的硬件木马检测需求,提出一种基于可控制性度量的图神经网络检测方法。该方法以门级网表作为输入,首先以可控制性值为指导,得到可疑的门节点,用于缩小搜索范围;然后利用可疑门节点生成对应的子图,利用图卷积神经网络从子图中提取特征,实现对子图的分类和检测,最终识别硬件木马。实验结果表明,该方法无须测试激励和黄金模型,利用硬件木马的隐蔽特性与结构特征相结合的方法提升硬件木马的检测准确率,平均真阳率为100%,假阳率为0.75%,在保证较高真阳率的同时可有效降低假阳率,达到较好的检测效果。
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关键词
知识产权核
硬件木马
可控制性度量
子图
图卷积神经网络
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职称材料
采用自适应连续时间线性均衡器和判决反馈均衡器算法的一种16 Gbit/s并转串/串转并接口
2
作者
文溢
陈建军
+2 位作者
黄俊
姚啸虎
刘衡竹
《电子与信息学报》
EI
CSCD
北大核心
2023年第11期3984-3990,共7页
该文在体硅CMOS工艺下设计了一种16 Gbit/s并转串/串转并接口(SerDes)芯片,该SerDes由4个通道(lanes)和2个锁相环(PLLs)组成。在接收器模拟前端(AFE)采用负阻抗结构连续时间线性均衡器(CTLE),得到22.9 dB高频增益,利用5-tap判决反馈均衡...
该文在体硅CMOS工艺下设计了一种16 Gbit/s并转串/串转并接口(SerDes)芯片,该SerDes由4个通道(lanes)和2个锁相环(PLLs)组成。在接收器模拟前端(AFE)采用负阻抗结构连续时间线性均衡器(CTLE),得到22.9 dB高频增益,利用5-tap判决反馈均衡器(DFE)进一步对信号码间干扰(ISI)做补偿,其中tap1做展开预计算处理,得到充足的时序约束条件。采用最小均方根(LMS)算法自适应控制CTLE和DFE的补偿系数来对抗工艺、电源和温度波动带来的影响。测试结果表明,芯片工作在16 Gbit/s时,总功耗为615 mW。发射器输出信号眼高为143 mV,眼宽43.8 ps(0.7UI),接收器抖动容忍指标在各频点均满足PCIe4.0协议要求,工作温度覆盖–55℃~125℃,电源电压覆盖0.9 V±10%,误码率小于1E-12。
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关键词
串转并/并转串接口
连续时间线性均衡器
判决反馈均衡器
最小均方根算法
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职称材料
题名
基于可控制性度量的图神经网络门级硬件木马检测方法
1
作者
张洋
刘畅
李少青
机构
国防科技大学计算机学院先进微处理器芯片与系统重点实验室
出处
《计算机工程》
CAS
CSCD
北大核心
2024年第7期164-173,共10页
基金
国家自然科学基金(61832018)。
文摘
随着全球化的不断深入,第三方知识产权(IP)核应用越来越广泛。随着硬件木马攻击技术逐渐成熟,使得在芯片设计阶段植入硬件木马成为可能。因此,在芯片设计过程中面临IP核被植入木马的严重威胁,现有研究所提的硬件木马检测方法具有依赖黄金参考电路、需要完备的测试向量、大量的样本进行学习等特征。面向IP核的硬件木马检测需求,提出一种基于可控制性度量的图神经网络检测方法。该方法以门级网表作为输入,首先以可控制性值为指导,得到可疑的门节点,用于缩小搜索范围;然后利用可疑门节点生成对应的子图,利用图卷积神经网络从子图中提取特征,实现对子图的分类和检测,最终识别硬件木马。实验结果表明,该方法无须测试激励和黄金模型,利用硬件木马的隐蔽特性与结构特征相结合的方法提升硬件木马的检测准确率,平均真阳率为100%,假阳率为0.75%,在保证较高真阳率的同时可有效降低假阳率,达到较好的检测效果。
关键词
知识产权核
硬件木马
可控制性度量
子图
图卷积神经网络
Keywords
Intellectual Property(IP)core
hardware Trojan
controllability metric
subgraph
graph convolutional neural network
分类号
TP391.4 [自动化与计算机技术—计算机应用技术]
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职称材料
题名
采用自适应连续时间线性均衡器和判决反馈均衡器算法的一种16 Gbit/s并转串/串转并接口
2
作者
文溢
陈建军
黄俊
姚啸虎
刘衡竹
机构
国防科技大学
计算机
科学
学院
先进
微处理器
芯片与
系统
重点
实验室
出处
《电子与信息学报》
EI
CSCD
北大核心
2023年第11期3984-3990,共7页
基金
国家自然科学基金(61974163,62174180)。
文摘
该文在体硅CMOS工艺下设计了一种16 Gbit/s并转串/串转并接口(SerDes)芯片,该SerDes由4个通道(lanes)和2个锁相环(PLLs)组成。在接收器模拟前端(AFE)采用负阻抗结构连续时间线性均衡器(CTLE),得到22.9 dB高频增益,利用5-tap判决反馈均衡器(DFE)进一步对信号码间干扰(ISI)做补偿,其中tap1做展开预计算处理,得到充足的时序约束条件。采用最小均方根(LMS)算法自适应控制CTLE和DFE的补偿系数来对抗工艺、电源和温度波动带来的影响。测试结果表明,芯片工作在16 Gbit/s时,总功耗为615 mW。发射器输出信号眼高为143 mV,眼宽43.8 ps(0.7UI),接收器抖动容忍指标在各频点均满足PCIe4.0协议要求,工作温度覆盖–55℃~125℃,电源电压覆盖0.9 V±10%,误码率小于1E-12。
关键词
串转并/并转串接口
连续时间线性均衡器
判决反馈均衡器
最小均方根算法
Keywords
Serializer/Deserializer(SerDes)interface
Continuous Time Linear Equalizer(CTLE)
Decision Feedback Equalizer(DFE)
Least Mean Square(LMS)algorithm
分类号
TN43 [电子电信—微电子学与固体电子学]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
基于可控制性度量的图神经网络门级硬件木马检测方法
张洋
刘畅
李少青
《计算机工程》
CAS
CSCD
北大核心
2024
0
下载PDF
职称材料
2
采用自适应连续时间线性均衡器和判决反馈均衡器算法的一种16 Gbit/s并转串/串转并接口
文溢
陈建军
黄俊
姚啸虎
刘衡竹
《电子与信息学报》
EI
CSCD
北大核心
2023
0
下载PDF
职称材料
已选择
0
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