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基于VHDL的8位除法器的实现 被引量:6
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作者 陈玉丹 齐京礼 陈建泗 《微计算机信息》 北大核心 2006年第12X期277-278,292,共3页
介绍了利用VHDL实现八位除法,采用层次化设计,给出了实现除法的子模块程序。使用Altera公司的MAX+PLUSI-I10.2开发软件进行功能仿真并给出仿真波形。
关键词 二进制除法 VHDL MAX+PLUS2
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VHDL语言在FPGA中的应用 被引量:14
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作者 齐京礼 宋毅芳 陈建泗 《微计算机信息》 北大核心 2006年第12Z期149-151,共3页
本文讨论了用VHDL语言进行FPGA设计的方法,简单介绍了VHDL语言的基本概念以及FPAG的设计流程,并举例说明了如何编写可综合的VHDL代码,使用Altera公司的MAX+PLUSII10.2开发软件进行功能仿真并给出仿真波形。
关键词 FPGA VHDL MAX+PLUS2
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