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一种基于FPGA的Viterbi译码器优化算法
被引量:
4
1
作者
蔡志龙
冯文江
杨洋
《现代电子技术》
2008年第17期105-107,共3页
Viterbi译码是卷积码的最佳译码算法,针对Viterbi译码器实现中资源消耗、译码速度、处理时延和结构等问题,通过对Viterbi译码算法及卷积码编码网格图特点的分析,提出一种在FPGA设计中,采用全并行结构、判决信息比特与路径信息向量同步...
Viterbi译码是卷积码的最佳译码算法,针对Viterbi译码器实现中资源消耗、译码速度、处理时延和结构等问题,通过对Viterbi译码算法及卷积码编码网格图特点的分析,提出一种在FPGA设计中,采用全并行结构、判决信息比特与路径信息向量同步存储以及路径度量最小量化的译码器优化实现方案。测试和试验结果表明,该方案与传统的译码算法相比,具有更高的速度、更低的时延和更简单的结构。
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关键词
卷积码
VITERBI算法
优化算法
现场可编程门阵列
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职称材料
题名
一种基于FPGA的Viterbi译码器优化算法
被引量:
4
1
作者
蔡志龙
冯文江
杨洋
机构
重庆
大学
重庆
华伟
工业
(
集团
)
有限公司
出处
《现代电子技术》
2008年第17期105-107,共3页
文摘
Viterbi译码是卷积码的最佳译码算法,针对Viterbi译码器实现中资源消耗、译码速度、处理时延和结构等问题,通过对Viterbi译码算法及卷积码编码网格图特点的分析,提出一种在FPGA设计中,采用全并行结构、判决信息比特与路径信息向量同步存储以及路径度量最小量化的译码器优化实现方案。测试和试验结果表明,该方案与传统的译码算法相比,具有更高的速度、更低的时延和更简单的结构。
关键词
卷积码
VITERBI算法
优化算法
现场可编程门阵列
Keywords
convolutional code
Viterbi algorithm
optimization algorithm
FPGA
分类号
TP31 [自动化与计算机技术—计算机软件与理论]
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题名
作者
出处
发文年
被引量
操作
1
一种基于FPGA的Viterbi译码器优化算法
蔡志龙
冯文江
杨洋
《现代电子技术》
2008
4
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